范文一:上升沿和下降沿触发
上升沿和下降沿触发
FPGA中的有关资料中提到不要同时使用时钟的上升沿和下降沿,这个说法曾让很多人迷惑过,今天就我的看法发表出来和大家探讨下:
第一种写法:在一个always 语句里面直接对上升沿和下降沿进行赋值
always @(posedge clk or negedge clk)
第二种写法:在不同的alwys语句里面在时钟的上升沿和下降沿对同一个寄存器进行赋值
always @(posedge clk ) begin .......reg1<=....end //对寄存器1赋值
always @(negedge clk) begin .......reg1<=....end // 对寄存器1赋值
第三种写法:在不同的alwys语句里面在时钟的上升沿和下降沿对不同寄存器进行赋值
always @(posedge clk ) begin .......reg1<=....end //对寄存器1赋值
always @(negedge clk) begin .........reg2<=....end // 对寄存器1赋值
很明显,第1和第一种写法是不可行的,在verilog的语法里面有说明,编译也明显通不过,
现在对第三种进行讨论,第三种是在时钟的上升沿和下降沿分别对不同的寄存器进行赋值处理,
上升沿和下降沿都使用,就相当于是电平触发,电平触发比时钟沿触发更容易受到干扰,在高速时
容易受干扰,也不够好。
解决方法
方法1.先通过PLL锁相环产生两个频率相同相位差为180度的clk1,
clk2,然后在每个clk的上升沿输出
always@(posedge clk1)
begin
...
end
always@(posedge clk2)
begin
...
end
方法2:通过PLL对clk进行倍频,得到clk2,那么clk2的上升沿也就
是clk的下降沿
always@(posedge clk)
begin
...
end
always@(posedge clk2)//相当于clk的下降沿
begin
...
end
方法3:如果对clk的下降沿操作只是用于后面的使能之用,可以把clk分频得到clk_new;
例如:
always @(posedge clk)
begin
clk_new<=!clk_new;//把clk_new当作是新时钟用,信号都是在clk_new的上升和下降沿触发
end
always @(posedge clk_new)//clk_new的上升沿
begin
....
end
always @(posedge clk)///clk_new的下降沿,由于clk信号是clk_new的二倍频,
begin
....
end
方法4:在低速信号处理的时候可以把clk取反得到一个新的时候clk_n
always @(posedge clk)
begin
end
always @(posedge clk_n)//取反后clk_n的上升沿也就是clk的上升沿
begin
end你说的这些解决方法只是在说明怎么产生clk,而在实际设计中如果想同时用时钟的上升和下降沿,关键问题不在于时钟怎么产生,而是寄存器怎么用。
当然CLK产生也是必须的。
第一种方法应该说是一种最佳的方法,PLL产生的时钟质量最好,而且能够直接上全局时钟网络。
第二种方法:clk2既然是倍频出来的,那么clk2的上升沿既是clk的上升沿也是clk的下降沿。
这种方法产生时钟最大的问题就是对时序的要求提高了一倍,因为时钟频率变味了两倍。
第三种方法:首先这种分频方法是不推荐的,最好用PLL实现而不是用LE资源实现(当然低频的设计这样做没有问题,但如果对频率要求不高,又何必采用上升和下降沿同时采呢,直接升高频率不就能提高系统的处理速度了吗~);其次posedge clk并不是negedge clk_new。
第四种方法:这样产生的时钟也是没有问题的,但是未必用于低速设计,clk和clk_n可以用全局时钟资源中的INV来产生,之后通过bufg直接上全局时钟,时钟质量没有问题的,不会比第一种方法差的。
如果有跟LZ理解上的偏差,请指出,谢谢。
楼主忽略了一个很重要的问题
为什么要上升沿下降沿同时都动作?那还不是因为时钟很高,不想用更高的时钟来工作,结果楼主直接说来个PLL2倍频的时钟,这样做失去了上升
下降同时工作的意义
而且也不存在说上升下降都动作就代表电平敏感,这个理解完全错误
实现的方法,通常是由两组寄存器,一组上升沿动作,一组下降沿动作
范文二: 试用上升沿触发的JK触发器设计 一时序电路
贵州大学课程设计报告
一时序电路
系 部: 电气工程及其自动化
专业班级:小组成员:_____XXX_______________ 指导教师:XXX_______
完成时间: 2010.1.11
课程名称: 试用上升沿触发的JK 触发器设计
数字电子技术基础课程设计报告
一. 设计要求
试用上升沿触发的JK 触发器设计一同步时序电路,其状态如图下图:
(
1
).
要
求
电
路
使
用
的
门
电
路
最
少
二. 设计的作用、目的 掌握JK 触发器的原理。
1 边沿JK 触发器的结构与原理
这种边沿触发器是利用门电路的传输延迟时间实现边沿触发的,电路结构如图1所示。
这个电路包含一个由与或非门G1和G2组成的基本RS 触发器和两个输入控制G3和G4。而且,门 G3和G4的传输时间大于基本RS 触发器的翻转时间。
设触发器的初始状态为Q = 0 、Q = 1 。 CP = 0时门B 、
、G3和G4同
时被CP 的低电平封锁。而由于G3和G4的输出 P 、 两端为高电平,门 A
、 是打开的,故基本RS 触发器的状态通过 A 、
得以保持。
图1 边沿JK 触发器
CP 变为高电平以后,门B 、
首先解除封锁,基本RS 触发器可以通过B 、
继续保持原状态不变。此时输入为J=1 、K=0 ,则通过门G3和G4的传输延迟时间后P=0、响。
当CP 下降沿到达时,门B 、迟时间,所以P 、
立即被封锁,但由于门G3和G4存在传输延
,门A 、
均不导通,对基本RS 触发器的状态没有影
的电平不会马上改变。因此,在瞬间出现A 、B 各有一个
,并经过
使Q = 0 。由于G3的传输延迟
输入端为低电平的状态,使
时间足够长,可以保证在P 点的低电平消失之前 Q 的低电平已反馈到了门A ,所以在P 点的低电平消失以后触发器获得的1状态将保持下去。
经过G3和G4的传输延迟时间后, P 和
都变为高电平,但对基本RS 触发
器的状态并无影响。同时,CP 的低电平已将门G3和G4封锁,J 、K 状态即使再发生变化也不会影响触发器的状态了。
2 特征表和特征方程
触发器稳定状态下J 、K 、
辑关系如特征表所示。
、
之间的逻
特征表
由特征表可得出特征方程:Q n +1 = JQn + KQ n
3 状态转换图和时序图
边沿JK 触发器的状态转换图和时序图如图2所示。图(a)为状态转换图,图(b)为时序图,边沿JK 触发器在给定输入信号J 、K 和CP 的作用下,Q1端输出为触发器时钟的动作沿是上升沿和Q2端输出为
下降沿的波形。
(a) (b)
图2 边沿JK 触发器的状态转换图时序图
3., 逻辑符号
边沿JK 触发器分上升边沿和下降边沿两种,它的逻辑符号如图3所示,CP 端有
空心圆符号的是下降边沿,无空心圆符号的是上升边沿。
(a) 上升边沿 (b) 下降边沿
图3 边沿JK 触发器的逻辑符号
4. 集成边沿JK 触发器
(1).TTL 集成边沿JK 触发器
图4.21(a)是TTL 集成边沿JK 触发器74LS112引出端功能图。
(2).CMOS 集成边沿JK 触发器
图4 (b)是CMOS 集成边沿JK 触发器CC4027引出端功能图。
(a) (b) 5. 逻辑符号
时序逻辑电路的分析和设计
分析步骤: 1、 写出驱动方程(激励)
2、 每一级的状态转移方程; 3、 画出状态转移图。
4、 检查自启动情况。 5、 写出电路功能。
6、 画出电路
设计步骤
1、 建立原始状态图和状态表
2、 状态简化(个人意见,这是数字电路设计中很麻烦的一步)
3、 状态分配(状态编码)
4、 选择存储器的类型,去定存储电路的激励输入
5、 求输出函数
6、 画逻辑图
7.时序逻辑电路的特点:任一时刻输出状态不仅取决于当
时的输入信号,还与电路原来的状态有关。因此时序电
路中必须含有存储器件。
8.时序逻辑电路的设计步骤一般为:设计要求→原始状态转
换图→状态化简→状态编码&触发器选择→激励表或状态方
程→激励方程/输出方程→自启动检查→逻辑图。
9.描述时序电路逻辑功能的方法有逻辑方程组、状态表、 状态图和时序图等。
10.时序逻辑电路的分析步骤一般为:逻辑图→时钟方程
异步)、激励方程、输出方程→状态方程→状态转换表
→状态转换图和时序图→逻辑功能。
三. 设计的具体实现
1. 系统概述
触发器:
触发器是构成时序逻辑电路的基本逻辑部件。 ?它有两个稳定的状态:0状态和1状态;
-在不同的输入情况下,它可以被置成0状态或1状态; ?当输入信号消失后,所置成的状态能够保持不变。
所以,触发器可以记忆1位二值信号。根据逻辑功能的不同,触发器可以分为
RS 触发器、D 触发器、JK 触发器、T 和T′触发器;按照结构形式的不同,又可分为基本RS 触发器、同步触发器、主从触发器和边沿触发器。
同步JK 触发器
信号输出端,Q=0、Q=1的状态称0状态,Q=1、Q=0的状态称1状态,信号输入端,低电平有效。
将S=JQn 、R=KQn 代入同步RS 触发器的特性方程,得同步JK
触发器的特性方程:
特性表
状态图
波形图
在数字电路中,凡在CP 时钟脉冲控制下,根据输入信号J 、K 情况的不同,具有置0、置1、保持和翻转功能的电路,都称为JK 触发器。
集成同步D 触发器
POL =1时,CP =1有效,锁存的内容是CP 下降沿时刻D 的值;POL =0时,CP =0有效,锁存的内容是CP 上升沿时刻D 的值。
主从JK 触发器
将
JK 触发器的特性方程:
主从JK 触发器没有约束。 特性表
时序图
逻辑符号
电路特点
①主从JK 触发器采用主从控制结构,从根本上解决了输入信号直接控制的问题,具有 CP =1期间接收输入信号,CP 下降沿到来时触发翻转的特点。 ②输入信号J 、K 之间没有约束。 ③存在一次变化问题
带清零端和预置端的主从JK 触发器
R D =0,直接置0S D =0,直接置1
集成主从JK 触发器
与输入主从JK 触发器的逻辑符号
主从JK 触发器功能完善,并且输入信号J 、K 之间没有约束。但主从JK 触发器还存在着一次变化问题,即主从JK 触发器中的主触发器,在CP =1期间其状态能且只能变化一次,这种变化可以是J 、K 变化引起,也可以是干扰脉冲引起,因此其抗干扰能力尚需进一步提高。
边沿JK 触发器
CP 下降沿时刻有效
边沿JK 触发器的逻辑符号
边沿JK 触发器的特点
①边沿触发,无一次变化问题。 ②功能齐全,使用方便灵活。 ③抗干扰能力极强,工作速度很高。
集成边沿JK 触发器
②CC4027为CP 上升沿触发,且其异步输入端R D 和S D 为高电平有效。
触发器是数字电路的极其重要的基本单元。触发器有两个稳定状态,在外界信号作用下,可以从一个稳态转变为另一个稳态;无外界信号作用时状态保持不变。因此,触发器可以作为二进制存储单元使用。
触发器的逻辑功能可以用真值表、卡诺图、特性方程、状态图和波形图等5种方式来描述。触发器的特性方程是表示其逻辑功能的重要逻辑函数,在分析和设计时序电路时常用来作为判断电路状态转换的依据。 各种不同逻辑功能的触发器的特性方程为: RS 触发器:Q n+1=S+RQn ,其约束条件为:RS =0 JK 触发器: Qn+1=JQn +KQn D 触发器: Qn+1=D T 触发器: Qn+1=TQn +TQn T '触发器: Qn+1=Qn
同一种功能的触发器,可以用不同的电路结构形式来实现;反过来,同一种电路结构形式,可以构成具有不同功能的各种类型触发器。
时序电路的特点:
逻辑电路分为两类:一类是组合逻辑电路,另一类是时序逻辑电路。在组合逻辑电路中,任一时刻的输出仅与该时刻输入变量的取值有关,而与输入变量的历史情况无关;在时序逻辑电路中,任一时刻的输出不仅与该时刻输入变量的取值有关,而且与电路的原状态,即与过去的输入情况有关。
与组合逻辑电路相比,时序逻辑电路有两个特点:第一,时序逻辑电路包含组合逻辑电路
和存储电路两部分,存储电路具有记忆功能,通常由触发器组成;第二,存储电路的状态反馈到组合逻辑电路的输入端,与外部输入信号共同决定组合逻辑电路的输出。组合逻辑电路的输出除包含外部输出外,还包含连接到存储电路的内部输出,它将控制存储电路状态的转移。
时序电路的分类
Z
同步二进制加法计数器
1
2
异步二进制加法计数器
时序电路按输出信号的特点又可以分为米里(Mealy )型和摩尔(Moore)型时序电路两种。Mealy 型时序电路的输出函数为 Z = F (X ,Q ),即某时刻的输出决定于该时刻的外部输入X 和内部状态Q ,如图6-4所示的Mealy 型串行加法器电路。在该电路中,a i 、b i 为串行数据输入,s i 为串行数据输出,s i =a i +b i +c i -1,或s i = a i +b i +Q 。Moore 型时序电路的输出函数为 Z = F (Q ),如图6-5所示的Moore 型串行加法器电路。在该电路中串行数据输出s i =Q 1。Mealy 型串行加法器电路和Moore 型串行加法器电路具有相同的逻辑功能,但Moore 型串行加法
器电路的输出比Mealy 型串行加法器的输出迟一个节拍。
Mealy 型串行加法器电路
a i i b i
a i b i
Moore 型串行加法器电路
时序电路的功能描述: 1. 逻辑方程式 Z =F (X , Q )
Y =G (X , Q )
Q n +1=H (Y , Q )
2. 状态转移表
状态转移表也称状态迁移表或状态表,是用列表的方式来描述时序逻辑电路输出Z 、次态Q n +1和外部输入X 、现态Q 之间的逻辑关系。
Mealy 型时序电路状态表
Moore 型时序电路状态表
Moore 型电路简化状态表 3. 状态图
00/0
11/0
00/1
10/1
X (a )
(b )
(c )
4. 时序图
即为时序电路的工作波形图,它以波形的形式描述时序电路内部状态Q 、外部输出Z 随输入信号X 变化的规律, 其具体画法将在下面讨论。 以上几种同步时序逻辑电路功能描述的方法,各有特点,但实质相同,且可以相互转换,它们都是同步时序逻辑电路分析和设计的主要工具。
同步时序逻辑电路的一般分析方法
①根据逻辑图求出时序电路的输出方程和各触发器的激励方程。
② 根据已求出的激励方程和所用触发器的特征方程, 获得时序电路的状态方程。 ③ 根据时序电路的状态方程和输出方程, 建立状态转移表, 进而画出状态图和波形图。 ④ 分析电路的逻辑功能。
2. 电路分析与设计(小三号宋体)
有效状态有
4个,故需两个触发器。设两触发器输出Q 1Q 0 , 则根据课本323
页图题6.3.3可得状态表如图6-1(a )
根据状态表和JK 触发器的激励表如表6-1(b )
可得两触发器的激励函数和输出函数真值表如表6-1(c )。
(a )。
由此真值表可画出下列卡诺图如图6-2(a )。由此真值表可画出下列卡诺图如图6-2
n
n
1
化简得:
J1 = Q 0, K1 = 0 ; J0 = A1 , K0 = AQ 1 , Z=AQ 1+Q 1Q 0
根据上述驱动方程可画出逻辑电路如图6-2(b )。
四.心得体会及建议
数电课程设计是培养学生综合运用所学知识, 发现, 提出, 分析和解决实际问题, 锻炼实践能力的重要环节, 是对学生实际工作能力的具体训练和考察过程. 回顾起此次课程设计,至今我仍感慨颇多,的确,从选题到定稿,从理论到实践,
在短短的两个星期的日子里,可以说得是苦多于甜,但是可以学到很多很多的的东西,同时不仅可以巩固了以前所学过的知识,而且学到了很多在书本上所没有学到过的知识。通过这次数电课程设计使我懂得了理论与实际相结合是很重要的,只有理论知识是远远不够的,只有把所学的理论知识与实践相结合起来,从理论中得出结论,从而提高自己的实际动手能力和独立思考的能力。在设计的过程中遇到问题,可以说得是困难重重,这毕竟第一次做数电课程设计,难免会遇到过各种各样的问题,同时在设计的过程中发现了自己的不足之处,对以前所学过的知识理解得不够深刻,掌握得不够牢固。
通过本次课程设计, 我明白了一个道理:无论做什么事情, 都必需养成严谨, 认真, 善思的工作作风.
时间很紧,这一周又在忙碌中过去了,经过一周的数电课程设计,我从原先看见状态图就一头雾水到现在能够设计复杂的同步时序电路,并且能够实现电路的仿真与实物板的制作与调试,之间的巨大变化着实令人吃惊。但是这种进步来之不易,因为这期间我遇到了很多的困难,发现了很多的问题,正是在解决问题的期间我才慢慢地熟悉了数字电子技术基础的基础知识,才慢慢学会了如何去按照给定的要求设计出合适的电路,作出电路的实物并对电路进行调试。
本次课程设计主要是运用本学期所学到的数字电子技术基础知识来设计一个符合要求的数字钟,本次设计不仅要求我们要掌握数字电子技术基础课程的基础知识,还要求我们对数字钟的各个组成部分的原理都有深刻的理解和掌握,本次课程设计最重要的是要求我们能够运用所学的知识将几种单元电路组合起来,并且能够根据给定性能指标求解电路中的参数,最后在实践方面还要求我们要有一定的动手能力.
课设的这段日子真的是给我留下了很深的印象。我总结出,在每次课设中,遇到问题最好的办法就是请教别人,因为每个人掌握的情况都不一样,一个人不可能做到处处都懂,必须发挥群众的力量,复杂的事情才能够简单化。这一点我深有体会,在很多时候,我遇到的困难或许别人之前就遇到过,向他们请教远比自己在那边摸索来得简单,来得快。
在这次课程设计过程中,我也遇到了很多问题。比如在真值表、波形图成正时,我就弄了很长时间,先是远离不清晰,这直接导致了我无法很顺利地连接电路,
然后翻阅了大量书籍,查资料,终于在书中查到了有关章节,并参考,编辑推荐:并设计出了真值表、波形图。但在设计数字频率计时就不是那么一帆风顺了。我同样是查阅资料,虽找到了原理框图,但电路图却始终设计不出来,最后实在没办法,只能用数字是中来代替。在此,我深表遗憾!
这次课程设计让我学到了很多,不仅是巩固了先前学的模电、数电的理论知识,而且也培养了我的动手能力,更令我的创造性思维得到拓展。希望今后类似这样课程设计、类似这样的锻炼机会能更多些!
五.附录
与运算 上升沿触发的JK 触发器
或运算 非运算
六.参考文献(三号宋体)
参考文献的格式如下:
[1] 伍时和主编. 数字电子技术基础。清华大学出版社,2009.4
[2] 高建新等主编. 电子技术实验与实训。机械工业出版社,2006.8
[3] 高吉祥主编. 电子技术基础实验与课程设计. 电子工业出版社,2002
[4] 孙淑艳主编. 电子技术实践教学指导书. 中国电力出版社,2005.10
[5] 吴老师. 贵州大学数字电子基础指导老师课件,2010.
([M]表示杂志刊物,[J]表示学术论文,[N]为报纸文章,如果参考文献来自网络,必须附上网址及访问时间。)
范文三:试用上升沿触发的JK触发器设计 一时序电路
贵州大学课程设计报告
课程名称: 试用上升沿触发的JK触发器设计
一时序电路
系 部: 电气工程及其自动化
专业班级:XXX_______
_XXX_______________ 小组成员:____
指导教师:XXX_______
完成时间: 2010.1.11
: 报告成绩
评阅教师 日期
数字电子技术基础课程设计报告
一.设计要求
试用上升沿触发的JK触发器设计一同步时序电路,其状态如图下图:
(1)(要求电路使用的门电路最少
二.设计的作用、目的
掌握JK触发器的原理。
1 边沿JK触发器的结构与原理
这种边沿触发器是利用门电路的传输延迟时间实现边沿触发的,电路结构如图1所示。
这个电路包含一个由与或非门G1和G2组成的基本RS触发器和两个输入控制G3和G4。而且,门 G3和G4的传输时间大于基本RS触发器的翻转时间。
设触发器的初始状态为Q = 0 、Q = 1 。 CP = 0时门B、 、G3和G4同
时被CP的低电平封锁。而由于G3和G4的输出 P、 两端为高电平,门 A、
是打开的,故基本RS触发器的状态通过 A、 得以保持。
图1 边沿JK触发器
CP变为高电平以后,门B、首先解除封锁,基本RS触发器可以通过B、继续保持原状态不变。此时输入为J=1 、K=0 ,则通过门G3和G4的传输延迟时间后P=0、 ,门A、均不导通,对基本RS触发器的状态没有影响。
当CP下降沿到达时,门B、 立即被封锁,但由于门G3和G4存在传输延迟时间,所以P、的电平不会马上改变。因此,在瞬间出现A 、B各有一个输入端为低电平的状态,使 ,并经过 使Q = 0 。由于G3的传输延迟时间足够长,可以保证在P点的低电平消失之前 Q 的低电平已反馈到了门A ,所以在P点的低电平消失以后触发器获得的1状态将保持下去。
经过G3和G4的传输延迟时间后, P 和 都变为高电平,但对基本RS触发器的状态并无影响。同时,CP的低电平已将门G3和G4封锁,J、K状态即使再发生变化也不会影响触发器的状态了。
2 特征表和特征方程
触发器稳定状态下J、K、 、 之间的逻
辑关系如特征表所示。 n+1J K Qn Q
0 0 0 0
0 0 1 1 特征表
0 1 0 0 由特征表可得出特征方程:Q= JQ+ KQ n+1 n n0 1 1 0
3 状态转换图和时序图 1 0 0 1
边沿JK触发器的状态转换图和时序图如图2所示。1 0 1 1
图(a)为状态转换图,图(b)为时序图,边沿JK触发1 1 0 1
器在给定输入信号J、K和CP的作用下,Q1端输1 1 1 0 出为触发器时钟的动作沿是上升沿和Q2端输出为下降沿的波形。
(a) (b)
图2 边沿JK触发器的状态转换图时序图
3.,逻辑符号
边沿JK触发器分上升边沿和下降边沿两种,它的逻辑符号如图3所示,CP端有
空心圆符号的是下降边沿,无空心圆符号的是上升边沿。
(a) 上升边沿 (b) 下降边沿
图3 边沿JK触发器的逻辑符号
4. 集成边沿JK触发器
(1)(TTL集成边沿JK触发器
图4.21(a)是TTL集成边沿JK触发器74LS112引出端功能图。
(2)(CMOS集成边沿JK触发器
图4 (b)是CMOS集成边沿JK触发器CC4027引出端功能图。
(a) (b) 5.逻辑符号
Q QQ QQ Q
2.特征方程
G G&& 12
Q Q
J CP K1J C1 1K
G G&&34
J CP KJ CP KJ CP K
(a) 逻辑电路(b) 曾用符号(c) 国标符号
时序逻辑电路的分析和设计
分析步骤:
1、 写出驱动方程(激励)
2、 每一级的状态转移方程;
3、 画出状态转移图。
4、 检查自启动情况。
5、 写出电路功能。
6、 画出电路
设计步骤
1、 建立原始状态图和状态表
2、 状态简化(个人意见,这是数字电路设计中很麻烦的一步)
3、 状态分配(状态编码)
4、 选择存储器的类型,去定存储电路的激励输入
5、 求输出函数
6、 画逻辑图
7(时序逻辑电路的特点:任一时刻输出状态不仅取决于当
时的输入信号,还与电路原来的状态有关。因此时序电
路中必须含有存储器件。
(时序逻辑电路的设计步骤一般为:设计要求?原始状态转 8
换图?状态化简?状态编码&触发器选择?激励表或状态方
程?激励方程/输出方程?自启动检查?逻辑图。
9(描述时序电路逻辑功能的方法有逻辑方程组、状态表、
状态图和时序图等。
10(时序逻辑电路的分析步骤一般为:逻辑图?时钟方程
异步)、激励方程、输出方程?状态方程?状态转换表
?状态转换图和时序图?逻辑功能。
三.设计的具体实现
1( 系统概述
触发器:
触发器是构成时序逻辑电路的基本逻辑部件。
?它有两个稳定的状态:0状态和1状态;
,在不同的输入情况下,它可以被置成0状态或1状态; ?当输入信号消失后,所置成的状态能够保持不变。 所以,触发器可以记忆1位二值信号。根据逻辑功能的不同,触发器可以分为
RS触发器、D触发器、JK触发器、T和T?触发器;按照结构形式的不同,又可分为基本RS触发器、同步触发器、主从触发器和边沿触发器。
同步JK触发器
信号输出端,Q=0、Q=1的状态称0状态,Q=1、Q=0的状态称1状态,信号输入端,低电平有效。
nn代入同步RS触发器的特性方程,得同步JK触发器的特性方程:将S=JQ、R=KQ
nnnnn,1Q,S,RQ,JQ,KQQ nn,JQ,KQ
特性表
JK=1×/
状态图
×0/0×/01
×1/
CP波形图 J
K
Q
Q
在数字电路中,凡在CP时钟脉冲控制下,根据输入信号J、K情况的不同,具有
置0、置1、保持和翻转功能的电路,都称为JK触发器。
集成同步D触发器
V4Q4D3D3Q 3Q 2Q2QV4D4Q4Q2G3Q3Q3DDD CC
16 15 14 13 12 11 10 9 16 15 14 13 12 11 10 9
CC404274LS375
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1Q1DCPPOL2D V4Q 1Q1Q 1G2Q2Q2D GND1D 1Q SS
(b) CC404的引脚图(a) 74LS375的引脚图
POL,1时,CP,1有效,锁存的内容是CP下降沿时刻D的值;POL,0时,CP,
0有效,锁存的内容是CP上升沿时刻D的值。
主从JK触发器
nn将 S,JQ R,KQ
代入主从RS触发器的特性方程,即可得到主从JK触发器的特性方程:
nn,1QSRQ,,
nnnJQKQQ,,
nnJQKQ,,
CP下降沿到来时有效
主从JK触发器没有约束。
特性表
nn+1功能 J K Q Q
0 0 0 0 n,1n 保持 Q,Q
0 0 1 1
0 1 0 0 n,1 置0 Q,00 1 1 0
1 0 0 1 n,1 置1 Q,11 0 1 1
1 1 0 1 n,1n 翻转 Q,Q
1 1 1 0
时序图
逻辑符号
Q QQ Q
Q Q CPC1 J K 1J 1K
J CP KJ CP K电路特点 曾用符号国标符号?主从JK触发器采用主从控制结构,从根本上解决了输入信号直接控制的问题,
,1期间接收输入信号,下降沿到来时触发翻转的特点。 具有 CPCP?输入信号J、K之间没有约束。
?存在一次变化问题
带清零端和预置端的主从JK触发器
R=0,直接置0S=0,直接置1 DD
带清零端和预置端的主从JK触发器的逻辑符号 Q Q Q Q
Q Q
SRDS RD DDCPC1 S 1J 1K R J K
J CP K SJ CP K RDD 曾用符号国标符号
集成主从JK触发器
VS RKK KQ1K1Q1QGND2K 2Q 2Q2JCC DD 3 2 1
16 15 14 13 12 11 10 9 14 13 12 11 10 9 8
74LS767472 1 2 3 4 5 6 7 1 2 3 4 5 6 7 8
1CP 1S 1R 1J V2CP2S 2RNC CPJJ JQ GNDDDCC DD 1 2 3
(a) 74LS76的引脚图(b) 7472的引脚图与输入主从JK触发器的逻辑符号
Q Q
1J 2K
CP&& S R
J J JCP K KKRSD 123 12 3 D
主从触发器功能完善,并且输入信号、之间没有约束。但主从触发器JKJKJK还存在着一次变化问题,即主从JK触发器中的主触发器,在CP,1期间其状态能且只能变化一次,这种变化可以是J、K变化引起,也可以是干扰脉冲引起,因此其抗干扰能力尚需进一步提高。
边沿JK触发器
Q Q
nn D,J,Q,KQ
&&nn,(J,Q),KQ nn,(J,Q)(K,Q)&&
nn ,JQ,KQ,JK1nn,JQ,KQ &&1n,1Q,D nn&&,JQ,KQJ?1 ?11D&KCPCP下降沿时刻有效 边沿JK触发器的逻辑符号
Q QQ Q
Q Q
CP J K C1 1J 1K
J CP K J CP K
国标符号曾用符号
边沿JK触发器的特点
?边沿触发,无一次变化问题。
?功能齐全,使用方便灵活。
?抗干扰能力极强,工作速度很高。
集成边沿JK触发器
2Q2Q2CP2R2K 2J2SV1R2R2CP2K2J2S 2QVDD D DCC D D D
16 15 14 13 12 11 10 9 16 15 14 13 12 11 10 9 CC402774LS112
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1Q1Q1CP1R1K1J1S V1CP1K1J1S1Q1Q2Q GND D DSS D
(b) CC4027的引脚图(a) 74LS112的引脚图
?74LS112为CP下降沿触发。
?CC4027为CP上升沿触发,且其异步输入端R和S为高电平有效。 DD
触发器是数字电路的极其重要的基本单元。触发器有两个稳定状态,在外界信号作用下,可以从一个稳态转变为另一个稳态;无外界信号作用时状态保持不变。因此,触发器可以作为二进制存储单元使用。
触发器的逻辑功能可以用真值表、卡诺图、特性方程、状态图和波形图等5种方式来描述。触发器的特性方程是表示其逻辑功能的重要逻辑函数,在分析和设计时序电路时常用来作为判断电路状态转换的依据。
各种不同逻辑功能的触发器的特性方程为:
n+1nRS触发器:Q=S+RQ,其约束条件为:RS,0
n+1nnJK触发器: Q=JQ+KQ
n+1D触发器: Q=D
n+1nnT触发器: Q=TQ+TQ
n+1nT,触发器: Q=Q
同一种功能的触发器,可以用不同的电路结构形式来实现;反过来,同一种电路结构形式,可以构成具有不同功能的各种类型触发器。
时序电路的特点:
逻辑电路分为两类:一类是组合逻辑电路,另一类是时序逻辑电路。在组合逻辑电路中,任一时刻的输出仅与该时刻输入变量的取值有关,而与输入变量的历史情况无关;在时序逻辑电路中,任一时刻的输出不仅与该时刻输入变量的取值有关,而且与电路的原状态,即与
过去的输入情况有关。
与组合逻辑电路相比,时序逻辑电路有两个特点:第一,时序逻辑电路包含组合逻辑电路
和存储电路两部分,存储电路具有记忆功能,通常由触发器组成;第二,存储电路的状态反馈到组合逻辑电路的输入端,与外部输入信号共同决定组合逻辑电路的输出。组合逻辑电路的输出除包含外部输出外,还包含连接到存储电路的内部输出,它将控制存储电路状态的转移。
时序电路的分类
&& Z
QQQ 0121J1J1J
C1C1C1
1K1K1K
FFFFFFCP012
同步二进制加法计数器
&Z
QQ01 Q1J1J1J2CPC1C1C1
1K1K1K FFFFFF012
异步二进制加法计数器
时序电路按输出信号的特点又可以分为米里(Mealy)型和摩尔(Moore)型时序电路两种。Mealy型时序电路的输出函数为 Z= F(X,Q),即某时刻的输出决定于该时刻的外部输入X和内部状态Q,如图6-4所示的Mealy型串行加法器电路。在该电路中,a、b为串行数据ii输入,s为串行数据输出,s=a+b+c,或s= a+b+Q。Moore型时序电路的输出函数为 Z = iiiii-1iii
F(Q),如图6-5所示的Moore型串行加法器电路。在该电路中串行数据输出s=Q。Mealyi1型串行加法器电路和Moore型串行加法器电路具有相同的逻辑功能,但Moore型串行加法器电路的输出比Mealy型串行加法器的输出迟一个节拍。
Mealy型串行加法器电路
ai?S ibi Ci,1CCCIOi FF Q1D
C1 CP
(S)a ii?bi SCiiCi,1CCIO
FFFF01 QQ011D1D
C1C1
CP
Moore型串行加法器电路
时序电路的功能描述:
1. 逻辑方程式 Z,F(X,Q)
Y,G(X,Q) n,1Q,H(Y,Q)
2. 状态转移表
状态转移表也称状态迁移表或状态表,是用列表的方式来描述时序逻辑电路输出
n+1Z、次态Q和外部输入X、现态Q之间的逻辑关系。
Mealy型时序电路状态表
Moore型时序电路状态表
Moore 型电路简化状态表
3.状态图
001/100/000/1 00000101001111/001/111/000/001/00001 100/0X/ZX10 10/111/0011011111010110010/1QQ X11/010
101/1QQ/Z11/110/010111000/101/1QQQ21010/110/1
0
(a)(b)(c)
4.时序图
即为时序电路的工作波形图,它以波形的形式描述时序电路内部状态Q、外部输出Z随
输入信号X变化的规律, 其具体画法将在下面讨论。 以上几种同步时序逻辑电路功能
描述的方法,各有特点,但实质相同,且可以相互转换,它们都是同步时序逻辑电路分
析和设计的主要工具。
同步时序逻辑电路的一般分析方法
?根据逻辑图求出时序电路的输出方程和各触发器的激励方程。
? 根据已求出的激励方程和所用触发器的特征方程, 获得时序电路的状态方程。 ? 根据时序电路的状态方程和输出方程, 建立状态转移表, 进而画出状态图和波形图。 ? 分析电路的逻辑功能。
2( 电路分析与设计(小三号宋体)
有效状态有4个,故需两个触发器。设两触发器输出QQ , 则根据课本32310
页图题6.3.3可得状态表如图6-1(a)
0 1 A
n n QQ 01n,1n,1 QQ /z 1 0
00 00/0 01/0
01 11/0 01/0
10 00/0 10/1
11 11/1 10/1
根据状态表和JK触发器的激励表如表6-1(b)
nn+1QQ J K
0 0 0 X
0 1 1 X
1 0 X 1
1 1 X 0
可得两触发器的激励函数和输出函数真值表如表6-1(c)。
n,1n,1n n A QQ Z JK JK QQ 1 10 001 0 1
0 0 0 0 0 0 0 X 0 X
0 0 1 1 1 0 1 X X 0
0 1 0 0 0 0 X 1 0 X
0 1 1 1 1 1 X 0 X 0
1 0 0 0 1 0 0 X 1 X
1 0 1 0 1 0 0 X X 0
1 1 0 1 0 1 X 0 0 X
1 1 1 1 0 1 X 0 X 1
由此真值表可画出下列卡诺图如图6-2(a)。由此真值表可画出下列卡诺图如图6-2
(a)。
n n J1?QQ0 100 01 11 10
1 X X 0
X X 1
化简得:
J= , K= ; J = A , K = A , AQ0Q1AQQ11 1 0 00
Z=A+ Q1Q1Q0
根据上述驱动方程可画出逻辑电路如图6-2(b)。
四(心得体会及建议
数电课程设计是培养学生综合运用所学知识,发现,提出,分析和解决实际问题,锻炼实践能力的重要环节,是对学生实际工作能力的具体训练和考察过程.回顾起此次课程设计,至今我仍感慨颇多,的确,从选题到定稿,从理论到实践,
在短短的两个星期的日子里,可以说得是苦多于甜,但是可以学到很多很多的的东西,同时不仅可以巩固了以前所学过的知识,而且学到了很多在书本上所没有学到过的知识。通过这次数电课程设计使我懂得了理论与实际相结合是很重要的,只有理论知识是远远不够的,只有把所学的理论知识与实践相结合起来,从理论中得出结论,从而提高自己的实际动手能力和独立思考的能力。在设计的过程中遇到问题,可以说得是困难重重,这毕竟第一次做数电课程设计,难免会遇到过各种各样的问题,同时在设计的过程中发现了自己的不足之处,对以前所学过的知识理解得不够深刻,掌握得不够牢固。
通过本次课程设计,我明白了一个道理:无论做什么事情,都必需养成严谨,认真,善思的工作作风.
时间很紧,这一周又在忙碌中过去了,经过一周的数电课程设计,我从原先看见状态图就一头雾水到现在能够设计复杂的同步时序电路,并且能够实现电路的仿真与实物板的制作与调试,之间的巨大变化着实令人吃惊。但是这种进步来之不易,因为这期间我遇到了很多的困难,发现了很多的问题,正是在解决问题的期间我才慢慢地熟悉了数字电子技术基础的基础知识,才慢慢学会了如何去按照给定的要求设计出合适的电路,作出电路的实物并对电路进行调试。
本次课程设计主要是运用本学期所学到的数字电子技术基础知识来设计一个符合要求的数字钟,本次设计不仅要求我们要掌握数字电子技术基础课程的基础知识,还要求我们对数字钟的各个组成部分的原理都有深刻的理解和掌握,本次课程设计最重要的是要求我们能够运用所学的知识将几种单元电路组合起来,并且能够根据给定性能指标求解电路中的参数,最后在实践方面还要求我们要有一定的动手能力.
课设的这段日子真的是给我留下了很深的印象。我总结出,在每次课设中,遇到问题最好的办法就是请教别人,因为每个人掌握的情况都不一样,一个人不可能做到处处都懂,必须发挥群众的力量,复杂的事情才能够简单化。这一点我深有体会,在很多时候,我遇到的困难或许别人之前就遇到过,向他们请教远比自己在那边摸索来得简单,来得快。
在这次课程设计过程中,我也遇到了很多问题。比如在真值表、波形图成正时,我就弄了很长时间,先是远离不清晰,这直接导致了我无法很顺利地连接电路,
然后翻阅了大量书籍,查资料,终于在书中查到了有关章节,并参考,编辑推荐:并设计出了真值表、波形图。但在设计数字频率计时就不是那么一帆风顺了。我同样是查阅资料,虽找到了原理框图,但电路图却始终设计不出来,最后实在没办法,只能用数字是中来代替。在此,我深表遗憾!
这次课程设计让我学到了很多,不仅是巩固了先前学的模电、数电的理论知识,而且也培养了我的动手能力,更令我的创造性思维得到拓展。希望今后类似这样课程设计、类似这样的锻炼机会能更多些!
五(附录
与运算 上升沿触发的JK触发器
或运算 非运算
六(参考文献(三号宋体)
参考文献的格式如下:
[1] 伍时和主编.数字电子技术基础。清华大学出版社,2009.4 [2] 高建新等主编.电子技术实验与实训。机械工业出版社,2006.8
[3] 高吉祥主编.电子技术基础实验与课程设计.电子工业出版社,2002
[4] 孙淑艳主编.电子技术实践教学指导书.中国电力出版社,2005.10
[5] 吴老师.贵州大学数字电子基础指导老师课件,2010. ([M]表示杂志刊物,[J]表示学术论文,[N]为报纸文章,如果参考文献来自网络,必须附上网址及访问时间。)
范文四:2016年度精品--试用上升沿触发的JK触发器设计 一时序电路
贵州大学课程设计报告
课程名称: 试用上升沿触发的JK触发器设计
一时序电路
系 部: 电气工程及其自动化
专业班级: XXX _______
_XXX_______________ 小组成员:____
指导教师: XXX _______
完成时间: 2010.1.11
: 报告成绩
评阅教师 日期
数字电子技术基础课程设计报告
一.设计要求
试用上升沿触发的JK触发器设计一同步时序电路,其状态如图下图:
(1)(要求电路使用的门电路最少
二.设计的作用、目的
掌握JK触发器的原理。
1 边沿JK触发器的结构与原理
这种边沿触发器是利用门电路的传输延迟时间实现边沿触发的,电路结构如图1所示。
这个电路包含一个由与或非门G1和G2组成的基本RS触发器和两个输入控制G3和G4。而且,门 G3和G4的传输时间大于基本RS触发器的翻转时间。
设触发器的初始状态为Q = 0 、Q = 1 。 CP = 0时门B、 、G3和G4同
时被CP的低电平封锁。而由于G3和G4的输出 P、 两端为高电平,门 A、
是打开的,故基本RS触发器的状态通过 A、 得以保持。
图1 边沿JK触发器
CP变为高电平以后,门B、首先解除封锁,基本RS触发器可以通过B、继续保持原状态不变。此时输入为J=1 、K=0 ,则通过门G3和G4的传输延迟时间后P=0、 ,门A、均不导通,对基本RS触发器的状态没有影响。
当CP下降沿到达时,门B、 立即被封锁,但由于门G3和G4存在传输延迟时间,所以P、的电平不会马上改变。因此,在瞬间出现A 、B各有一个输入端为低电平的状态,使 ,并经过 使Q = 0 。由于G3的传输延迟时间足够长,可以保证在P点的低电平消失之前 Q 的低电平已反馈到了门A ,所以在P点的低电平消失以后触发器获得的1状态将保持下去。
经过G3和G4的传输延迟时间后, P 和 都变为高电平,但对基本RS触发器的状态并无影响。同时,CP的低电平已将门G3和G4封锁,J、K状态即使再发生变化也不会影响触发器的状态了。
2 特征表和特征方程
触发器稳定状态下J、K、 、 之间的逻
辑关系如特征表所示。 n+1J K Qn Q
0 0 0 0
0 0 1 1 特征表
0 1 0 0 由特征表可得出特征方程:Q= JQ+ KQ n+1 n n0 1 1 0
3 状态转换图和时序图 1 0 0 1
边沿JK触发器的状态转换图和时序图如图2所示。1 0 1 1
图(a)为状态转换图,图(b)为时序图,边沿JK触发1 1 0 1
器在给定输入信号J、K和CP的作用下,Q1端输1 1 1 0 出为触发器时钟的动作沿是上升沿和Q2端输出为下降沿的波形。
(a) (b)
图2 边沿JK触发器的状态转换图时序图
3.,逻辑符号
边沿JK触发器分上升边沿和下降边沿两种,它的逻辑符号如图3所示,CP端有
空心圆符号的是下降边沿,无空心圆符号的是上升边沿。
(a) 上升边沿 (b) 下降边沿
图3 边沿JK触发器的逻辑符号
4. 集成边沿JK触发器
(1)(TTL集成边沿JK触发器
图4.21(a)是TTL集成边沿JK触发器74LS112引出端功能图。
(2)(CMOS集成边沿JK触发器
图4 (b)是CMOS集成边沿JK触发器CC4027引出端功能图。
(a) (b) 5.逻辑符号
Q QQ QQ Q
2.特征方程
G G&& 12
Q Q
J CP K1J C1 1K
G G&&34
J CP KJ CP KJ CP K
(a) 逻辑电路(b) 曾用符号(c) 国标符号
时序逻辑电路的分析和设计
分析步骤:
1、 写出驱动方程(激励)
2、 每一级的状态转移方程;
3、 画出状态转移图。
4、 检查自启动情况。
5、 写出电路功能。
6、 画出电路
设计步骤
1、 建立原始状态图和状态表
2、 状态简化(个人意见,这是数字电路设计中很麻烦的一步)
3、 状态分配(状态编码)
4、 选择存储器的类型,去定存储电路的激励输入
5、 求输出函数
6、 画逻辑图
7(时序逻辑电路的特点:任一时刻输出状态不仅取决于当
时的输入信号,还与电路原来的状态有关。因此时序电
路中必须含有存储器件。
(时序逻辑电路的设计步骤一般为:设计要求?原始状态转 8
换图?状态化简?状态编码&触发器选择?激励表或状态方
程?激励方程/输出方程?自启动检查?逻辑图。
9(描述时序电路逻辑功能的方法有逻辑方程组、状态表、
状态图和时序图等。
10(时序逻辑电路的分析步骤一般为:逻辑图?时钟方程
异步)、激励方程、输出方程?状态方程?状态转换表
?状态转换图和时序图?逻辑功能。
三.设计的具体实现
1( 系统概述
触发器:
触发器是构成时序逻辑电路的基本逻辑部件。
? 它有两个稳定的状态:0状态和1状态;
? 在不同的输入情况下,它可以被置成0状态或1状态; ? 当输入信号消失后,所置成的状态能够保持不变。 所以,触发器可以记忆1位二值信号。根据逻辑功能的不同,触发器可以分为
RS触发器、D触发器、JK触发器、T和T?触发器;按照结构形式的不同,又可分为基本RS触发器、同步触发器、主从触发器和边沿触发器。
同步JK触发器
信号输出端,Q=0、Q=1的状态称0状态,Q=1、Q=0的状态称1状态,信号输入端,低电平有效。
nn代入同步RS触发器的特性方程,得同步JK触发器的特性方程: 将S=JQ、R=KQ
nnnnn,1Q,S,RQ,JQ,KQQ nn,JQ,KQ
特性表
JK=1×/
状态图
×0/0×/01
×1/
CP波形图 J
K
Q
Q
在数字电路中,凡在CP时钟脉冲控制下,根据输入信号J、K情况的不同,具有
置0、置1、保持和翻转功能的电路,都称为JK触发器。
集成同步D触发器
V4Q4D3D3Q 3Q 2Q2QV4D4Q4Q2G3Q3Q3DDD CC
16 15 14 13 12 11 10 9 16 15 14 13 12 11 10 9
CC404274LS375
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1Q1DCPPOL2D V4Q 1Q1Q 1G2Q2Q2D GND1D 1Q SS
(b) CC404的引脚图(a) 74LS375的引脚图
POL,1时,CP,1有效,锁存的内容是CP下降沿时刻D的值;POL,0时,CP,
0有效,锁存的内容是CP上升沿时刻D的值。
主从JK触发器
nn 将 S,JQ R,KQ
代入主从RS触发器的特性方程,即可得到主从JK触发器的特性方程:
nn,1QSRQ,,
nnnJQKQQ,,
nnJQKQ,,
CP下降沿到来时有效
主从JK触发器没有约束。
特性表
nn+1功能 J K Q Q
0 0 0 0 n,1n 保持 Q,Q
0 0 1 1
0 1 0 0 n,1 置0 Q,00 1 1 0
1 0 0 1 n,1 置1 Q,11 0 1 1
1 1 0 1 n,1n 翻转 Q,Q
1 1 1 0
时序图
逻辑符号
Q QQ Q
Q Q CPC1 J K 1J 1K
J CP KJ CP K电路特点 曾用符号国标符号?主从JK触发器采用主从控制结构,从根本上解决了输入信号直接控制的问题,
,1期间接收输入信号,下降沿到来时触发翻转的特点。 具有 CPCP?输入信号J、K之间没有约束。
?存在一次变化问题
带清零端和预置端的主从JK触发器
R=0,直接置0 S=0,直接置1 DD
带清零端和预置端的主从JK触发器的逻辑符号 Q Q Q Q
Q Q
SRDS RD DDCPC1 S 1J 1K R J K
J CP K SJ CP K RDD 曾用符号国标符号
集成主从JK触发器
VS RKK KQ1K1Q1QGND2K 2Q 2Q2JCC DD 3 2 1
16 15 14 13 12 11 10 9 14 13 12 11 10 9 8
74LS767472 1 2 3 4 5 6 7 1 2 3 4 5 6 7 8
1CP 1S 1R 1J V2CP2S 2RNC CPJJ JQ GNDDDCC DD 1 2 3
(a) 74LS76的引脚图(b) 7472的引脚图与输入主从JK触发器的逻辑符号
Q Q
1J 2K
CP&& S R
J J JCP K KKRSD 123 12 3 D
主从触发器功能完善,并且输入信号、之间没有约束。但主从触发器JKJKJK还存在着一次变化问题,即主从JK触发器中的主触发器,在CP,1期间其状态能且只能变化一次,这种变化可以是J、K变化引起,也可以是干扰脉冲引起,因此其抗干扰能力尚需进一步提高。
边沿JK触发器
Q Q
nn D,J,Q,KQ
&&nn,(J,Q),KQ nn,(J,Q)(K,Q)&&
nn ,JQ,KQ,JK1nn,JQ,KQ &&1n,1Q,D nn&&,JQ,KQJ?1 ?11D&KCPCP下降沿时刻有效 边沿JK触发器的逻辑符号
Q QQ Q
Q Q
CP J K C1 1J 1K
J CP K J CP K
国标符号曾用符号
边沿JK触发器的特点
?边沿触发,无一次变化问题。
?功能齐全,使用方便灵活。
?抗干扰能力极强,工作速度很高。
集成边沿JK触发器
2Q2Q2CP2R2K 2J2SV1R2R2CP2K2J2S 2QVDD D DCC D D D
16 15 14 13 12 11 10 9 16 15 14 13 12 11 10 9 CC402774LS112
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1Q1Q1CP1R1K1J1S V1CP1K1J1S1Q1Q2Q GND D DSS D
(b) CC4027的引脚图(a) 74LS112的引脚图
?74LS112为CP下降沿触发。
?CC4027为CP上升沿触发,且其异步输入端R和S为高电平有效。 DD
触发器是数字电路的极其重要的基本单元。触发器有两个稳定状态,在外界信号作用下,可以从一个稳态转变为另一个稳态;无外界信号作用时状态保持不变。因此,触发器可以作为二进制存储单元使用。
触发器的逻辑功能可以用真值表、卡诺图、特性方程、状态图和波形图等5种方式来描述。触发器的特性方程是表示其逻辑功能的重要逻辑函数,在分析和设计时序电路时常用来作为判断电路状态转换的依据。
各种不同逻辑功能的触发器的特性方程为:
n+1nRS触发器:Q=S+RQ,其约束条件为:RS,0
n+1nnJK触发器: Q=JQ+KQ
n+1D触发器: Q=D
n+1nnT触发器: Q=TQ+TQ
n+1nT,触发器: Q=Q
同一种功能的触发器,可以用不同的电路结构形式来实现;反过来,同一种电路结构形式,可以构成具有不同功能的各种类型触发器。
时序电路的特点:
逻辑电路分为两类:一类是组合逻辑电路,另一类是时序逻辑电路。在组合逻辑电路中,任一时刻的输出仅与该时刻输入变量的取值有关,而与输入变量的历史情况无关;在时序逻辑电路中,任一时刻的输出不仅与该时刻输入变量的取值有关,而且与电路的原状态,即与
过去的输入情况有关。
与组合逻辑电路相比,时序逻辑电路有两个特点:第一,时序逻辑电路包含组合逻辑电路
和存储电路两部分,存储电路具有记忆功能,通常由触发器组成;第二,存储电路的状态反馈到组合逻辑电路的输入端,与外部输入信号共同决定组合逻辑电路的输出。组合逻辑电路的输出除包含外部输出外,还包含连接到存储电路的内部输出,它将控制存储电路状态的转移。
时序电路的分类
&& Z
QQQ 0121J1J1J
C1C1C1
1K1K1K
FFFFFFCP012
同步二进制加法计数器
&Z
QQ01 Q1J1J1J2CPC1C1C1
1K1K1K FFFFFF012
异步二进制加法计数器
时序电路按输出信号的特点又可以分为米里(Mealy)型和摩尔(Moore)型时序电路两种。Mealy型时序电路的输出函数为 Z= F(X,Q),即某时刻的输出决定于该时刻的外部输入X和内部状态Q,如图6-4所示的Mealy型串行加法器电路。在该电路中,a、b为串行数据ii输入,s为串行数据输出,s=a+b+c,或s= a+b+Q。Moore型时序电路的输出函数为 Z = iiiii-1iii
F(Q),如图6-5所示的Moore型串行加法器电路。在该电路中串行数据输出s=Q。Mealyi1型串行加法器电路和Moore型串行加法器电路具有相同的逻辑功能,但Moore型串行加法器电路的输出比Mealy型串行加法器的输出迟一个节拍。
Mealy型串行加法器电路
ai?S ibi Ci,1CCCIOi FF Q1D
C1 CP
(S)a ii?bi SCiiCi,1CCIO
FFFF01 QQ011D1D
C1C1
CP
Moore型串行加法器电路
时序电路的功能描述:
1. 逻辑方程式 Z,F(X,Q)
Y,G(X,Q) n,1Q,H(Y,Q)
2. 状态转移表
状态转移表也称状态迁移表或状态表,是用列表的方式来描述时序逻辑电路输出
n+1Z、次态Q和外部输入X、现态Q之间的逻辑关系。
Mealy型时序电路状态表
Moore型时序电路状态表
Moore 型电路简化状态表
3.状态图
001/100/000/1 00000101001111/001/111/000/001/00001 100/0X/ZX10 10/111/0011011111010110010/1QQ X11/010
101/1QQ/Z11/110/010111000/101/1QQQ21010/110/1
0
(a)(b)(c)
4.时序图
即为时序电路的工作波形图,它以波形的形式描述时序电路内部状态Q、外部输出Z随
输入信号X变化的规律, 其具体画法将在下面讨论 。 以上几种同步时序逻辑电路功
能描述的方法,各有特点,但实质相同,且可以相互转换,它们都是同步时序逻辑电路
分析和设计的主要工具。
同步时序逻辑电路的一般分析方法
? 根据逻辑图求出时序电路的输出方程和各触发器的激励方程。
? 根据已求出的激励方程和所用触发器的特征方程, 获得时序电路的状态方程。
? 根据时序电路的状态方程和输出方程, 建立状态转移表, 进而画出状态图和波形图。
? 分析电路的逻辑功能。
2( 电路分析与设计(小三号宋体)
有效状态有4个,故需两个触发器。设两触发器输出QQ , 则根据课本10323页图题6.3.3可得状态表如图6-1(a)
0 1 A
n n QQ 0 1n,1n,1 Q Q /z 1 0
00 00/0 01/0
01 11/0 01/0
10 00/0 10/1
11 11/1 10/1
根据状态表和JK触发器的激励表如表6-1(b)
nn+1 QQ J K
0 0 0 X
0 1 1 X
1 0 X 1
1 1 X 0
可得两触发器的激励函数和输出函数真值表如表6-1(c)。
n,1n,1 n n A QQ Z JK JK Q Q 1 10 00 1 0 1
0 0 0 0 0 0 0 X 0 X
0 0 1 1 1 0 1 X X 0
0 1 0 0 0 0 X 1 0 X
0 1 1 1 1 1 X 0 X 0
1 0 0 0 1 0 0 X 1 X
1 0 1 0 1 0 0 X X 0
1 1 0 1 0 1 X 0 0 X
1 1 1 1 0 1 X 0 X 1
由此真值表可画出下列卡诺图如图6-2(a)。由此真值表可画出下列卡诺图如图6-2
(a)。
n n J1?QQ 0 100 01 11 10
1 X X 0
X X 1
化简得:
J= , K= ; J = A , K = A , AQ0Q1AQQ11 1 0 00Z=A+ Q1Q1Q0
根据上述驱动方程可画出逻辑电路如图6-2(b)。
四(心得体会及建议
数电课程设计是培养学生综合运用所学知识,发现,提出,分析和解决实际问题,锻炼实践能力的重要环节,是对学生实际工作能力的具体训练和考察过程.回顾起此次课程设计,至今我仍感慨颇多,的确,从选题到定稿,从理论到实践,在短短的两个星期的日子里,可以说得是苦多于甜,但是可以学到很多很多的的东西,同时不仅可以巩固了以前所学过的知识,而且学到了很多在书本上所没有学到过的知识。通过这次数电课程设计使我懂得了理论与实际相结合是很重要的,只有理论知识是远远不够的,只有把所学的理论知识与实践相结合起来,从理论中得出结论,从而提高自己的实际动手能力和独立思考的能力。在设计的过程中遇到问题,可以说得是困难重重,这毕竟第一次做数电课程设计,难免会遇到过各种各样的问题,同时在设计的过程中发现了自己的不足之处,对以前所学过的知识理解得不够深刻,掌握得不够牢固。
通过本次课程设计,我明白了一个道理:无论做什么事情,都必需养成严谨,认真,善思的工作作风.
时间很紧,这一周又在忙碌中过去了,经过一周的数电课程设计,我从原先看见状态图就一头雾水到现在能够设计复杂的同步时序电路,并且能够实现电路的仿真与实物板的制作与调试,之间的巨大变化着实令人吃惊。但是这种进步来之不易,因为这期间我遇到了很多的困难,发现了很多的问题,正是在解决问题的期间我才慢慢地熟悉了数字电子技术基础的基础知识,才慢慢学会了如何去按照给定的要求设计出合适的电路,作出电路的实物并对电路进行调试。
本次课程设计主要是运用本学期所学到的数字电子技术基础知识来设计一个符合要求的数字钟,本次设计不仅要求我们要掌握数字电子技术基础课程的基础知识,还要求我们对数字钟的各个组成部分的原理都有深刻的理解和掌握,本次课程设计最重要的是要求我们能够运用所学的知识将几种单元电路组合起来,并且能够根据给定性能指标求解电路中的参数,最后在实践方面还要求我们要有一定的动手能力.
课设的这段日子真的是给我留下了很深的印象。我总结出,在每次课设中,遇到问题最好的办法就是请教别人,因为每个人掌握的情况都不一样,一个人不可能做到处处都懂,必须发挥群众的力量,复杂的事情才能够简单化。这一点我深有体会,在很多时候,我遇到的困难或许别人之前就遇到
过,向他们请教远比自己在那边摸索来得简单,来得快。
在这次课程设计过程中,我也遇到了很多问题。比如在真值表、波形图成正时,我就弄了很长时间,先是远离不清晰,这直接导致了我无法很顺利地连接电路,然后翻阅了大量书籍,查资料,终于在书中查到了有关章节,并参考,编辑推荐:并设计出了真值表、波形图。但在设计数字频率计时就不是那么一帆风顺了。我同样是查阅资料,虽找到了原理框图,但电路图却始终设计不出来,最后实在没办法,只能用数字是中来代替。在此,我深表遗憾!
这次课程设计让我学到了很多,不仅是巩固了先前学的模电、数电的理论知识,而且也培养了我的动手能力,更令我的创造性思维得到拓展。希望今后类似这样课程设计、类似这样的锻炼机会能更多些!
五(附录
与运算 上升沿触发的JK触发器
或运算 非运算
六(参考文献(三号宋体)
参考文献的格式如下:
[1] 伍时和主编.数字电子技术基础。清华大学出版社,2009.4 [2] 高建新等主编.电子技术实验与实训。机械工业出版社,2006.8
[3] 高吉祥主编.电子技术基础实验与课程设计.电子工业出版社,2002
[4] 孙淑艳主编.电子技术实践教学指导书.中国电力出版社,2005.10
[5] 吴老师.贵州大学数字电子基础指导老师课件,2010. ([M]表示杂志刊物,[J]表示学术论文,[N]为报纸文章,如果参考文献来自网络,必须附上网址及访问时间。)
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财务工作总结ppt
[财务工作总结ppt]一、合理安排收支预算,严格预算管理 单位预算是学校完成各项工作任务,实现事业计划的重要前提,因此认真做好我校的收支预算责任重大,财务工作总结ppt。为了搞好这项工作,根据学校上年度的实际情况,拟定的预算方案,特别是支出方案多次向学校领导汇报,进行了反复修改,本着;以收定支,量入为出;,使预算更加切合实际。充分发挥在财务管理中的积极作用,较圆满地完成预算编制任务。在实际执行过程中,严格按照预算执行,每月未编制好计划用款报表,充分体现了资金的使用效益,确保学校
各项工作的顺利完成。
二、认真做好收费、结算工作
收费是学校最为繁琐,也是政策最强的一项工作,为了做好这项工作,我们及早做好申报审批工作,做到收费的依据,严格执行收费标准。及时出具票据,期未做好结算工作,做到多退少不补,同时做好代收
费;报告书;的上报。
三、认真做好决算工作
年终决算也是一项较为复杂繁重的工作任务,主要进行结旧建新,编制决算报表,决算报表是反映学校一年度的财务收支情况,是指导学校预算执行工作的重要资料,也是编制下年度收支计划的基础,所以除了认真细致地做好年终决算外,同时针对所编制的报表进行对比性分析,通过分析,总结经验,揭示存在的问题,为学校领导决策提供
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依据。
四、努力学习,提高财会人员的自身素质。 财务人员能积极参加镇组织的业务培训,不断的提高财会知识和政策水平,同时积极参加学校的一切政治学习,认真作好学习笔记,认真贯彻执行《合计法》,使学校的财会工作能按照国家的政策、法规进
行,保证支出的真实性,合法性。
五、努力完成学校的后勤工作
后勤工作将直接影响到学校的一切工作,搞好食堂更为重要,为此总在放学前拟定好下学期的伙食收费报表报局计划财务科,严格执行计划财务科核定的标准收龋本着服务于学生目的,规范伙食成本,控制
伙食利润,按规定时间上报食堂报表。
【扩展阅读篇】
工作总结格式一般分为:标题、主送机关、正文、署名四部分。 (1)标题。一般是根据工作总结的中心内容、目的要求、总结方向来定。同一事物因工作总结的方向;;侧重点不同其标题也就不同。工作总结标题有单标题,也有双标题。字迹要醒目。单标题就是只有一个题目,如《我省干部选任制度改革的一次成功尝试》。一般说,工作总结的标题由工作总结的单位名称、工作总结的时间、工作总结的内容或种类三部分组成。如;××市化工厂1995年度生产工作总结;;××市××研究所1995年度工作总结;也可以省略其中一部分,如:;三季度工作总结;,省略了单位名称,工作总结《财务工作总结ppt》。**的《关于打退第二次**高潮的总结》,
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其标题不仅省略了总结的单位名称,也省略了时限。双标题就是分正副标题。正标题往往是揭示主题;;即所需工作总结提炼的东西,副标题往往指明工作总结的内容、单位、时间等。例如:辛勤拼搏结硕
果;;××县氮肥厂一九九五年工作总结;; (2)前言。即写在前面的话,工作总结起始的段落。其作用在于用简炼的文字概括交代工作总结的问题;或者说明所要总结的问题、时间、地点、背景、事情的大致经过;或者将工作总结的中心内容:主要经验、成绩与效果等作概括的提示;或者将工作的过程、基本情况、突出的成绩作简洁的介绍。其目的在于让读者对工作总结的全貌有一个
概括的了解、为阅读、理解全篇打下基础。 (3)正文。正文是工作总结的主体,一篇工作总结是否抓住了事情的本质,实事求是地反映出了成绩与问题,科学地总结出了经验与教训,文章是否中心突出,重点明确、阐述透彻、逻辑性强、使人信,全赖于主体部分的写作水平与质量。因此,一定要花大力气把立体部分的材料安排好、写好。正文的基本内容是做法和体会、成绩和缺点、经
验和教训。
1)成绩和经验这是工作总结的目的,是正文的关键部分,这部分材料如何安排很重要,一般写法有二。一是写出做法,成绩之后再写经验。即表述成绩、做法之后从分析成功的原因、主客观条件中得出经验教益。二是写做法、成绩的同时写出经验,;寓经验于做法之中;。也有在做法,成绩之后用;心得体会;的方式来介绍经验,这实际是前一种写法。成绩和经验是工作总结的中心和重点,是构成工作总结正文的
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支柱。所谓成绩是工作实践过程中所得到的物质成果和精神成果。所谓经验是指在工作中取得的优良成绩和成功的原因。在工作总结中,成绩表现为物质成果,一般运用一些准确的数字表现出来。精神成果则要用前后对比的典型事例来说明思想觉悟的提高和精神境界的高尚,使精神成果在工作总结中看得见、摸得着,才有感染力和说明力。 2)存在的问题和教训一般放在成绩与经验之后写。存在的问题虽不在每一篇工作总结中都写,但思想上一定要有个正确的认识。每篇工作总结都要坚持辩论法,坚持一分为二的两点论,既看到成绩又看到存在的问题,分清主流和枝节。这样才能发扬成绩、纠正错误,虚心谨
慎,继续前进。
写存在的问题与教训要中肯、恰当、实事求是。 (4)结尾一般写今后努力的方向,或者写今后的打算。这部分要精炼、
简洁。
(5)署名和日期。署名写在结尾的右下方,在署名下边写上工作总结的年、月、日,如为突出单位,把单位名称写在标题下边,则结尾只落
上日期即可。
简而言之:
总结,就是把某一时期已经做过的工作,进行一次全面系统的总检查、总评价,进行一次具体的总分析、总研究;也就是看看取得了哪些成绩,存在哪些缺点和不足,有什么经验、提高。 那么,工作总结怎
么写?个人工作总结的格式是怎样的?详情请看下文解析。
(一)基本情况
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1. 总结必须有情况的概述和叙述,有的比较简单,有的比较详细。这部分内容主要是对工作的主客观条件、有利和不利条件以及工作的
环境和基础等进行分析。
2. 成绩和缺点。这是总结的中心。总结的目的就是要肯定成绩,找出缺点。成绩有哪些,有多大,表现在哪些方面,是怎样取得的;缺点有多少,表现在哪些方面,是什么性质的,怎样产生的,都应讲清
楚。
3. 经验和教训。做过一件事,总会有经验和教训。为便于今后的工作,须对以往工作的经验和教训进行分析、研究、概括、集中,并上
升到理论的高度来认识。
今后的打算。根据今后的工作任务和要求,吸取前一时期工作的经验和教训,明确努力方向,提出改进措施等。具体可以参考部分工作总
结范文。
财务工作总结的ppt [财务工作总结的ppt]财务工作总结的ppt一、合理安排收支预算,严
格预算管理
单位预算是学校完成各项工作任务,实现事业计划的重要前提,因此认真做好我校的收支预算责任重大,财务工作总结的ppt。为了搞好这项工作,根据学校上年度的实际情况,拟定的预算方案,特别是支出方案多次向学校领导汇报,进行了反复修改,本着“以收定支,量入为出”,使预算更加切合实际。充分发挥在财务管理中的积极作用,
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各项工作的顺利完成。
二、认真做好收费、结算工作
收费是学校最为繁琐,也是政策最强的一项工作,为了做好这项工作,我们及早做好申报审批工作,做到收费的依据,严格执行收费标准。及时出具票据,期未做好结算工作,做到多退少不补,同时做好代收
费“报告书”的上报。
三、认真做好决算工作
年终决算也是一项较为复杂繁重的工作任务,主要进行结旧建新,编制决算报表,决算报表是反映学校一年度的财务收支情况,是指导学校预算执行工作的重要资料,也是编制下年度收支计划的基础,所以除了认真细致地做好年终决算外,同时针对所编制的报表进行对比性分析,通过分析,总结经验,揭示存在的问题,为学校领导决策提供
依据。
四、努力学习,提高财会人员的自身素质。 财务人员能积极参加镇组织的业务培训,不断的提高财会知识和政策水平,同时积极参加学校的一切政治学习,认真作好学习笔记,认真贯彻执行《合计法》,使学校的财会工作能按照国家的政策、法规进
行,保证支出的真实性,合法性。
五、努力完成学校的后勤工作
后勤工作将直接影响到学校的一切工作,搞好食堂更为重要,为此总
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或种类三部分组成。如“××市化工厂1995年度生产工作总结”“××市××研究所1995年度工作总结”也可以省略其中一部分,如:“三季度工作总结”,省略了单位名称,工作总结《财务工作总结的ppt》。**的《关于打退第二次**高潮的总结》,其标题不仅省略了总结的单位名称,也省略了时限。双标题就是分正副标题。正标题往往是揭示主题——即所需工作总结提炼的东西,副标题往往指明工作总结的内容、单位、时间等。例如:辛勤拼搏结硕果
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验和教训。
1)成绩和经验这是工作总结的目的,是正文的关键部分,这部分材料如何安排很重要,一般写法有二。一是写出做法,成绩之后再写经验。即表述成绩、做法之后从分析成功的原因、主客观条件中得出经验教益。二是写做法、成绩的同时写出经验,“寓经验于做法之中”。也有在做法,成绩之后用“心得体会”的方式来介绍经验,这实际是前一种写法。成绩和经验是工作总结的中心和重点,是构成工作总结正文的支柱。所谓成绩是工作实践过程中所得到的物质成果和精神成果。所谓经验是指在工作中取得的优良成绩和成功的原因。在工作总结中,成绩表现为物质成果,一般运用一些准确的数字表现出来。精神成果则要用前后对比的典型事例来说明思想觉悟的提高和精神境界的高尚,使精神成果在工作总结中看得见、摸得着,才有感染力和说明力。 2)存在的问题和教训一般放在成绩与经验之后写。存在的问题虽不在每一篇工作总结中都写,但思想上一定要有个正确的认识。每篇工作总结都要坚持辩论法,坚持一分为二的两点论,既看到成绩又看到存
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在的问题,分清主流和枝节。这样才能发扬成绩、纠正错误,虚心谨
慎,继续前进。
写存在的问题与教训要中肯、恰当、实事求是。 (4)结尾一般写今后努力的方向,或者写今后的打算。这部分要精炼、
简洁。
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(一)基本情况
1. 总结必须有情况的概述和叙述,有的比较简单,有的比较详细。这部分内容主要是对工作的主客观条件、有利和不利条件以及工作的
环境和基础等进行分析。
2. 成绩和缺点。这是总结的中心。总结的目的就是要肯定成绩,找出缺点。成绩有哪些,有多大,表现在哪些方面,是怎样取得的;缺点有多少,表现在哪些方面,是什么性质的,怎样产生的,都应讲清
楚。
3. 经验和教训。做过一件事,总会有经验和教训。为便于今后的工
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作,须对以往工作的经验和教训进行分析、研究、概括、集中,并上
升到理论的高度来认识。
今后的打算。根据今后的工作任务和要求,吸取前一时期工作的经验和教训,明确努力方向,提出改进措施等。具体可以参考部分工作总
结范文。
(二)写好总结需要注意的问题
1. 一定要实事求是,成绩不夸大,缺点不缩小,更不能弄虚作假。
这是分析、得出教训的基础。
2. 条理要清楚。总结是写给人看的,条理不清,人们就看不下去,
即使看了也不知其所以然,这样就达不到总结的目的。 3. 要剪裁得体,详略适宜。材料有本质的,有现象的;有重要的,有次要的,写作时要去芜存精。总结中的问题要有主次、详略之分,该详的要详,该略的要略。另外,在结尾处也可以附上下一步个人工作
计划。
财务工作总结开头语
[财务工作总结开头语]财务工作总结开头语总结开头的撰著方法多端,富于变化,不拘泥一格,没有固定的标准样式,财务工作总结开头语。但一般的规律还是有的,这就是要根据总结的类型.以及所要表现的大旨来决定如何范笔,以实现开头的精确性、鲜明性、生动性。这里,
仅就目前常见的几种开头方法,先容于后。
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(一)概说式开头
概说式开头,这是周全工作总结常用的一种写法。在开头处一般要概说基本情况,把要总结的工作的配景、时间、地点、经过及有关前提交处理代清晰,有时候也要把首要成就、经验、问题须要提出来,先给读者一个总的印象。例如,**同志的《开国-年在西南》一文的开头如次:紧接着1949年10月1日开国仪式之后,我们人民解放军熬头、第2、第四周的原野战军的部队衔命进军西南,直捣美蒋匪帮在大陆上的最后果穴,解放西南7000万人民。从11月初发起战斗到12月27日止,先后不外57天,就基本上竣事了这个战役。在此期间,人民解放军进步了1000千米,消灭了敌军90万。今后,我们进行了比行军作战大为复杂困难的工作,9个月(云南是7个月)的努
力是有结果就的。
这个开头不到200字,却归纳综合了至关富厚的内部实质意义,将工作配景、工作时间、工作基本情况交代得清清晰楚,具体而明确,既凸起了军事的乐成,又赐顾帮衬到其他方面的工作。整个开头部分写得扼要而滇密,鲜明而凸起,语言持重朴实,没有夸张措绘,读后,
给人留下深刻的印象。
(二)论证式开头
论证式的开头,这是周全工作总结的另一种开头方法。在开头处不写基本情况,而是直裁了当提出上级指示精神,或者有关方针政策,然后路程经过过程可作例子的事来论证这类指示、方针、政策的不错性。
例如,**同志的《三个月的总结》一文的开头如次:
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7月20日中央对时局的指示上说;”我们是可以或者许打败**的。全党对此应有充分的决定信念。”七、8、9三个月的作战,业已经证实了此项断语是不错的。用3个月的争取解放而进行的战的实践论证了中央指示的不错性,这….开头,情势新鲜,别具一格,文字未
几,却具备高高在上的气焰。
(三)结论式开头
结论式的开头,就是先作结论,后叙述大概情况。这类开头方法最为常见,并且多用于周全性的工作总结。其写法就是在开头处.以高度归纳综合的笔法,说明工作是在什么情况下进行的,并对此项工作的结果,做出明确的结论,然后,用一过渡句,自然引出下文。例如.各单位财务工作总结的开头如次:一年来,我们坚持勤俭建国,勤俭办企业的方针,坚持为生产办事,为群众办事,严格执行国度的规章制度,实行经济核算,加强财务办理,促进了生产的发展,阐扬了财
务工作的作用。我们在工作中的体会首要有以下几个方面: 这个开头.既写了配景、事情原因、依据,又点出了做过会么,结果怎么样(即结论)--”促进了生产的发展,阐扬了财务工作的作用。”
文字虽则未几,但它直接把总结的内部实 质意义,闪现在读者眼前,使人一看便得到全文的方法,开头总述完了以后,接着用了-个过渡句,自然引出下文的详细叙述,这样的开头,条理清晰,归纳综合性强,过渡自然,易于读者理解总结的内部
实质意义,工作总结《财务工作总结开头语》。
(四)提问式开头
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提问式的开头,是在开头处根据大旨的需要,先提出问题,然后导致下文;这类开头方法多用于专题经验性的总结。例如,**同志的《八路军抗战两年来的经验教训》一文的开头如次:八路军抗战两年以来,
我们得到了一些什么经验教训呢?
这样的开头,就是用简练精练的文字,以提问的情势,直接点明了总结的重点。这类开篇设疑的写法,比较新鲜、生动,很能导致人们的
关注,具备一定的启发性和魔力,既省笔墨,成效又好。
(五)对比
对比式开头,是在开头处对有关情况:如过去与现在、后退与进步;错误与不错等等做一番归纳综合交代与比较,在比较中表明所是与所非;这类开头方法多用于专题性的经验总结。例如,黑龙江省肇洲县人民当局写的《横向结合架起致富的金桥》”-文的开头:党的十一届三中全会以来,我县工农业生产有了很大发展,开端转变了掉队面孔。1985年工农业总产值可达24万元.比1980年翻一番。实现了财政收支平衡,略有节余,比1984年增加45.19%,比1980年增加了31.7倍。1985年县办工业亏损企业由1980年的13户减少到4户,国营预算内工业企业全部消灭亏损。竣事了我县工业持续4年亏损的历史。肇州县一欠亨铁路,二不靠江河,三没有丛林,缺乏天然资源,工业根蒂根基薄弱,财政经济状况能在较短的期间内得到明显好转,靠的是什么呢?是结合协作发展工业。它为我县的经济带来了生机和活力。
mjk心得体会
这个开头的落笔重点,是放在经济发展变化上。路程经过过程先后两
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个阶段的、几个典型数值的对比,有力地说明了县办的工场企业,要增加产量增收扭亏为盈,关键是要进行经济体制鼎新,实行结合协作发展工业,提高经营办理程度,这样的对比.质料翔实,言之有物,
有使心服力,能给读者留下鲜明而深刻的印象。
(六)提示式开头
提示式开头,这是专题性经验总结的一种常用开头方法。在开头处对工作的首要内部实质意义做提示性的先容,其目的就是引出对于所取得的经验的叙述。例如,《深切开展抱负教育,提高职工队伍本质》一文开头如次:几年来,我们盘绕企业鼎新和生产建设,广泛深切地
开展抱负教育。我们的首要作法是:
又如,《以鼎新的精神,推进班组民主理理》一文开头如次:在鼎新的新形势下,如何进一步加强班组建设,是摆在我们眼前的一个重要的课题。底下是我们的一些作法:再如,《我们是如何施用干部任命和免职权的》一文开头如次:近两年来,我们按照中央的”四化”要
求,在鼎新干部办理制度方面首要做了以下工作:
从上面所说的3个例子可以看出,这类提示式开头的 写法好处在丁简练明确、能惹人注目。总之,总结开头的情势是多样的,可是无论如何,外头应该是写明全文的大旨,给人以归纳综合的印象,导致读者的注意,给人以启发,这是写解开头的关键所在。工作总结的开头对于一份工作总结的整体而言很是重要。工作总结开头怎么写呢?以下从几篇优秀的工作总结开头语中提练出几种工作总结
的开头,希望各人能从中领略到工作总结开头怎么写。
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典范一:
工作室主任引领着工作室的大事小事的办理规范,做好工作总结尤为重要。工作室主任工作总结怎么写?以下是一篇工作室主任工作总结
范文,各人在编撰工作总结时,不妨予以参考。
典范二:
在黉舍党支部,校委会的不错领导下,在镇财政所的不错指导下,较好的完成为了本学期的收支计划,保证了黉舍的一样平常工作的顺遂
进行,现将本学期黉舍的财务工作总结如次:
典范三:
半年来,在领导和同志们的帮忙下,自己在政治思想和工作方面都取患了一些成就,底下就将教师上半年工作总结汇报如次,敬请各位师
生提出宝贵定见及建议。
财务工作主要业绩
[财务工作主要业绩]财务工作主要业绩光阴如梭,半年的工作转瞬又将成为历史,今天站在这个发言席上,我多想骄傲自豪地说一声:“一份耕坛一份收获,我没有辜负领导的期望”,财务工作主要业绩。然而,近阶段的工作检查与仓库管理员的理论考试的结果,让我切切实实看到了财务管理的许多薄弱之处,作为财务部的主要责任领导,我负有不可推卸的责任。“务实、求实、抓落实”,对照公司的精益管理高标准严要求,唯有先调整自己的理念,彻底转变观念,从全新的
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角度审视和重整自身工作,才能让各项工作真正落实到实处,下面进
行财务工作总结2011公司业绩报告如下: 财务工作总结其一、年初至今,财务部整个条线人员一直没有得到过稳定,大事小事,压在身上,往往重视了这头却忽视了那头,有点头
轻脚重没能全方位地进行管理;
财务工作总结其二、人员的不够稳定使工作进入疲劳状态,恶性循环,
导致工作思路不清晰,忽略了管理员的业务培训。 财务工作总结其三、主观上思想有过动摇,未给自己加压,没有真正
进入角色;
财务工作总结其四、忽略了团队管理,与各级领导、各个部门之间缺
乏沟通;
财务工作总结其五、工作思路上没有创新意识,比如目标管理思路上
不清晰,绩效管理上力度不够,出现问题后处理力度不够; 以上几点是我部门与个人存在的最主要的问题根源,财务部门作为公司的一个主要职能监督部门,“当好家、理好财,更好地服务企业”是我财务部门应尽的职责。在公司加强管理、规范经济行为、提高企业竞争力等等方面我们负有很大的义务与责任。只有不断的反省与总
结,管理工作才能得到提高!
“查找不足赶先进,立足根本争先进”,时值润发集团提出“树标兵、学先进、促发展、争效益”活动、润发机械又一度成为整个集团的标兵企业,“鑫宏企业与本公司进行对口红旗竞赛”的今天,作为个人我们要实现体现自已的人身价值,企业的兴衰直接关系到个人的荣辱,
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作为财务管理部门,为公司实现共同的目标我们要添砖加瓦,学习润机的六种精神:艰苦创业精神、改革创新精神、拓展市场精神、精益管理精神、永不满足精神、顾全大局精神。我们要把这六种精神贯穿于具体的工作中中去,下半年工作作为财务部的主要责任领导,对于“如何提高自我,服务于企业”这门必修课,我将不断地加强学习,完善自我,把“学习先进、赶超先进、争当先进”融入到工作中去,重点将放在加强仓库管理与财务分析这二块,下面就工作计划与思路
向大会作一汇报:
一、财务工作总结完善公司内部管理制度;部门责任领导明确分工的
职责,加强责任考核;
内部管理制度通过将近一年多来的实施,仍然有许多不合理的地方,为使企业的管理制度更趋于完善,财务部将结合集团管理的要求,与
有关部门进行修正,工作总结《财务工作主要业绩》。 部门责任领导之间明确分工职责, 按照年初签定的责任合同,组织落实强化到位,领导之间相互信任,遇事不推诿, 搞好通力协助,对分管内
容加强责任考核力度,做到奖罚分明; 二、财务工作总结针对此次突击检查与仓库管理员的业务理论考试,合理调整组合人力资源,继续加强培训力度与仓库管理检查监督力度; 今年以来,人事方面至今一直未得到稳定,财务部门的力量相对比较薄弱,通过近期突击检查工作与仓库管理员的突击考试,我们将根据库房各位管理人员的特点,一方面将对人员重新组合搭配, 进行高效有序的组织,另一方面继续加强培训,让每一位仓库管理人员都要做到对
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各库的业务熟悉,真正做到驾熟就轻,文化素质与业务管理水平都要有质的提高,今年3月电脑真正联网,管理员的电脑操作水平还有待于进一步提高,我们将在这方面加强培训,使每一位管理人员都能熟悉电脑、
掌握电脑操作,扎扎实实提高每个管理员的业务管理水平, 会议之后我们将严格对仓库管理员实施目标管理与绩效管理,确定目标,达成目标,加强考核监督力度,与工资挂勾,真正做到奖罚分明。 四、财务工作总结加强团队建设,充分发挥财务职能部门的作用: 作为财务部的责任领导,既是一名财务工作人员,也是财务管理制度的组织者,要有严谨、廉洁的工作作风和认真细致的工作态度,对条线人员要积极引导,做到上行下效,帮助条线人员解决问题,充分发挥团队的合作精神,学先进、赶先进、超先进,在条线中展开竞赛活动,发挥团队的力量,拧成一股绳,劲往一处使;在坚持原则的同时,我们坚持“三个满意二个放心”,三个满意是“让客户满意、让员工满意、让各部门主管领导满意”,二个放心是“让集团公司领导放心,
让公司的老总与各级领导放心”;
五、财务工作总结加大各项费用控制力度,充分发挥财务的核算与监
督职能;
今年是精益管理年、效益满意年、科技创新年,我们将继续加强各项费用的控制,行使财务监督职能,审核控制好各项开支,在财务核算
工作中尽心尽职,认真处理审核每一笔业务;
六、财务工作总结搞好财务分析,为领导提供有效的参考依据; 我知道合理高效的财务分析思路与方法,是企业管理和决策水平提高
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的重要途径,并将使我们的工作事半功倍,在企业成本分析上向沈科学习、向车间的老师傅学习、向书本学习,为企业的生产经营销售,做好保本点与规模效益、销售定价分析等等,量化分析具体的财务数据,并结合企业总体战略,为企业决策和管理提供有力的财务信息支
持;
七、财务工作总结加强应收款催收管理力度,控制好库存材料与产品,
提高资金的运行质量,合理控制资金的使用: 公司发展至今,生产资金的筹集,一直是个头痛的问题,大家都知道资金就跟人体的血液一样重要,我们公司的主要特点是物资采购量大、生产批量大、销售批量大,筹集资金是财务的一个主要职能,良好的银企关系,是企业融资的一根纽带,目前我们只能在应收款管理与库存管理上进行控制,压缩库存,合理生产,控制资金的流向,使库存原辅材料在保证生产的同时控制到最底线,在资金尤为紧张的情况下,
财务部将从采购材料与产成品这一块有效地跟踪好资金的运作;
八、财务工作总结继续做好各部门工资奖金的核算工作: 今年公司对各部门都签订了责任合同,我财务部将继续严谨细致而认真地按照责任合同严格审核结算工资,并组织资金确保工资的发放; 以上财务工作总结是我财务部2011年的主要工作,还有与集团搞好过渡衔接、废品的管理、规范财务核算程序等一系列工作都是我财务的一些本职工作,“查找不足赶先进,立足根本争先进”,这不是句空话,号角之声响起我们就要付诸与行动,利用团队精神集思广益,财务条线所有人员重点思考如何在管理上创新,如何在实施成本控制
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上做文章!总之,今后的工作中,还是年初责任领导会议上的那句财务工作总结:我将不断地总结与反省,不断地鞭策自己并充实能量,提高自身素质与业务水平,以适应时代和企业的发展,与各位共同进
步,与公司共同成长。
财务工作中的问题
[财务工作中的问题]财务工作中的问题一、基层人民银行会计财务工作中的问题
(一)会计财务内控制度不健全,岗位职责不明确
一是制度不健全落实更难,财务工作中的问题。二是监督制约机制形同虚设,事前、事中、事后监督没有形成环环相扣,层层把关的安全线,特别是在事后监督上更显不足。大部分基层行没有设臵专职的事后监督人员,核算的准确性受到影响,资金的安全受到威胁。三是岗位责任不明确,相互推诿扯皮现象严重,影响了工作的效率和水平。同时对原有的岗位责任制度没有进行及时修订完善,也没有很好地实行定期或不定期轮岗及强行休假制度,制度不明、责任不清,导致会计财务工作规范程度差,严重影响了会计财务工作的质量和水平。 (二)联行业务集中,产生新的内控风险
会计核算集中后,联行往账会计信息和原始凭证核对分离,形成内控风险。会计核算集中后,人民银行县支行的联行被取消,作为核算中心的网点,只办理往账业务的信息录入及来账业务的信息读取,联行业务统一由核算中心联行柜进行处理。其目的是为了规避因人员少、
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素质不高而引发的内控风险,但是联行业务集中后,又产生新的内控风险。以前每笔联行往账业务,均有原始凭证与联行往账报单或事后核查单相互核对,可以及时发现少发、错发、漏发联行往账的差错。但是核算集中后,县支行只负责录入原始凭证有关信息,再由中心支行的核算中心生成和发出联行业务,这样就形成了县支行虽然有原始凭证,却无法与实际发出的往账核对;而核算中心联行柜按照网点发来的信息进行处理,却无法核对信息的真实性、准确性和完整性,这必然导致内控风险。
(三)会计岗位设定与现有会计人员配臵的矛盾
按照内控制度的要求,县支行会计国库科承担着会计管理和会计核算双重职能,一般应设臵接柜岗、记账岗、复核岗、联行岗、综合岗、系统维护岗、会计主管岗、事后监督岗、电子联行岗、票据交换岗、结算管理岗、会计档案管理岗等岗位。其中事后监督员、票据交换员、系统维护员、会计主管员不得参与日间账务处理,记账员、复核员必须交叉,联行来账、往账和联行对账与管理必须分离,英押、证必须分开管理,但实际工作中存在人少岗位多的矛盾。要保证正常业务的开展,必须一人多岗,一人多责,如遇培训、外出检查、正常休假等情况,兼岗和顶班就不可避免。人少岗位多的矛盾还体现在两个方面,一是不按制度要求充实会计人员,就会不同程度出现混岗、兼岗现象,各个岗位之间的相互制约关系不复存在,风险隐患较大;另一方面是县支行人员较少,会计业务量较小,按制度要求充实会计人员,势必造成会计人员占全行人员比重较大,人力资源浪费,不利于县支行其
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他工作的开展。
二、基层人民银行会计财务工作对策
(一)全面落实会计财务各项检查制度,进一步规范会计工作行为 一是建立和健全会计财务检查监督机制,定期或不定期地开展事前、事中、事后等多层次、全方位、多形式的会计财务检查监督,对一切风险隐患及时提出整改意见,对违规操作的行为要进行严肃处理。二是全面落实会计财务工作自查与定期检查制度,坚决避免搞形式、走过场,要将各项检查制度落到实处,扎扎实实开展检查工作,每一次检查要研究制定检查方案,落实检查责任制,形成会计财务工作人员向会计财务主管负责、会计财务主管向分管行长负责、分管行长向行长负责的三级责任区,层层落实责任;要通过自查、定期检查等形式,对所有会计财务业务进行全过程的检查监督,形成环环相公务员之家www.G扣、层层把关的安全线;对查出的问题不隐瞒、不回避,敢于发现和暴露问题,树立会计财务工作无小事的意识,真正发挥检查监督的作用,确保资金安全,工作规范。三是检查内容要全面,检查重点要突出,切不可厚此薄彼,特别是要对联行清算、账户管理、会计财务核算、费用开支、内控制度执行进行重点检查,及时发现问题,防止差错,堵塞漏洞,从而保证会计财务核算的真实、准确、及时和完整,工作总结《财务工作中的问题》。
(二)提高对会计管理工作重要性的认识
要高度重视和支持会计工作,从观念上实现两个转变,从工作上处理好一个关系。一是会计人员思想观念的转变。中央银行会计是宏观金
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融管理的主要组成部分之一,会计人员在管理范围上,不仅要管好中央银行的基础货币,及时办理各金融机构的缴存款及其相互之间的资金清算,还要做好管理结算,在管理内容上会计部门要利用其掌握的第一手资料,搞好会计分析,通过其固有的反映监督职能,为宏观管理提供可靠信息。同时做好内部资金和财务的管理,提高资金使用效益。二是会计工作要实现由核算型到管理型的观念转变。即以记账、算账、报表、费用核算为中心的会计核算体系转到以加强监督管理,保证资金安全为中心,以执行中央银行货币政策为主要任务的会计核算体系,中央银行会计工作范围也要逐步延伸拓宽,反映、控制、监督、管理、分析、预测都是中央银行会计的职能和任务。一个关系是处理好会计改革和加强会计管理的关系,作为金融管理职能部门之一的会计部门,管理与改革同等重要。因此应当处理好改革与管理的关系,改革可以促进管理水平的提高,而管理水平的提高又为改革的顺利进行开辟道路。人民银行会计应加快改革步伐,尽早与国际会计准则接轨。
(三)加强信息的交流和沟通,共享信息资源
内部会计控制作为一个动态系统,它包括不同环节之间持续不断的信息流和资金流,其每个控制环节都执行不同程序,并与其他环节相互作用与影响。因此,整体会计控制价值最大化的实现,一方面需要风险管理委员牵头组织各成员间的沟通,以实现信息共享,优势互补,有针对性地开展工作,同时有助于消除部门间的误解和疑虑;另一方面各职能部门要加强自身员工间的沟通,培养和提高员工参与会计控
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制的意识,以便开展自评。在实践中,最有效的解决方法就是促使内部会计控制信息沟通的制度化,形成一种约束机制。
(四)关心理解会计人员,多举措稳定会计队伍
一是开展会计人员法制教育和职业道德教育,广泛开展“八荣八耻”教育学习活动,提倡爱岗敬业的精神,树立正确的世界观、价值观、人生观,努力提高会计人员的思想品德,使会计人员真正地热爱会计工作,并在提高自身素质上下功夫。二是坚持以人为本,适当提高会计人员的待遇。各级领导干部要带头关心基层会计人员的思想动态,解决他们的实际困难,建立业务量、风险度与待遇相对称的激励机制,营造重视会计工作的氛围,提高会计人员热爱会计工作的积极性,真正做到“用感情留人,用事业留人”。三是完善业绩考核机制,提高会计人员的适应能力,正确处理国库部门、营业部门与事后监督中心之间的关系,正确看待业务差错,认真分析差错类型,测算业务量与差错的合理比例,减轻一线会计人员的心理压力。四是加强管理,建立科学的激励机制。加强与人事、内审、监察部门的积极配合,使管理工作更具有客观性、全局性和系统性,将报酬与劳动成果相结合,使风险与待遇相对称,对会计工作全年无差错、无事故发生的会计人员应予奖励。
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范文五:试用上升沿触发的JK触发器设计一时序电路
贵州大学课?程设计报告?
课程名称: 试用上升沿?触发的JK?触发器设计?
一时序电路?
系 部: 电气工程及?其自动化
__ 专业班级: XXX _____?
小组成员:_____?XXX__?_____?_____?___
指导教师: XXX _____?__
完成时间: 2010.1.11
报告成绩:
评阅教师 日期
数字电子技?术基础课程?设计报告 一.设计要求
试用上升沿?触发的JK?触发器设计?一同步时序?电路,其状态如图?下图:
(1)(要求电路使?用的门电路?最少
二.设计的作用?、目的
掌握JK触发器的原理??。
1 边沿JK触?发器的结构?与原理
这种边沿触?发器是利用?门电路的传?输延迟时间?实现边沿触?发的,电路结构如图1?所示。
这个电路包?含一个由与?或非门G1?和G2组成?的基本RS?触发器和两?个输入控制?G3和G4?。而且,门 G3和G4?的传输时间?大于基本R?S触发器的?翻转时间。
设触发器的?初始状态为?Q = 0 、Q = 1 。 CP = 0时门B、 、G3和G4?同时被CP?的低电平封?锁。而由于G3?和G4的输?出 两端为高电 P、?平,门 A、 是打开的,故基本RS?触发器的状?态通过 A、 得以保持。
图1 边沿JK触?发器
CP变为高?电平以后,门B、首先解除封?锁,基本RS触?发器可以通?过B、继续保持原?状态不变。此时输入为?J=1 、K=0 ,则通过门G?3和G4的?传输延迟时?间后P=0、 ,门A、均不导通,对基本RS?触发器的状?态没有影响?。
当CP下降?沿到达时,门B、 立即被封锁?,但由于门G?3和G4存?在传输延迟?时间,所以P、的电平不会?马上改变。因此,在瞬间出现?A 、B各有一个?输入端为低?电平的状态?,使 ,并经过 使Q = 0 。由于G3的?传输延迟时?间足够长,可以保证在?P点的低电?平消失之前? Q 的低电平已?反馈到了门?A ,所以在P点?的低电平消?失以后触发?器获得的1?状态将保持?下去。
经过G3和?G4的传输?延迟时间后?, P 都变为高电和?平,但对基本R?S触发器的?状态并无影?响。同时,CP的低电?平已将门G?3和G4封?锁,J、K状态即使?再发生变化?也不会影响?触发器的状?态了。
2 特征表和特?征方程
触发器稳定?状态下J、K、 、 之间的逻辑?关系如特征?表所示。
n+1 K Qn QJ
特征表 0 0 0 0
由特征表可?得出特征方?程:Q= JQ+ KQ n+1 n n0 0 1 1
3 状态转换图?和时序图 0 1 0 0
边沿JK触?发器的状态?转换图和时?序图如图2?所示。0 1 1 0 图(a)为状态转换?图,图(b)为时序图,边沿JK触?发
器在给定?输入信号J?、K和CP的?作用下,Q1端输1 0 0 1
出?为触发器时?钟的动作沿?是上升沿和?Q2端输出?为
下降沿的?波形。 1 0 1 1
1 1 0 1
1 1 1 0
(a) (b)
图2 边沿JK触?发器的状态?转换图时序?图
3.,逻辑符号
边沿JK触?发器分上升?边沿和下降?边沿两种,它的逻辑符?号如图3所?示,CP端有
空心圆符号?的是下降边?沿,无空心圆符?号的是上升?边沿。
(a) 上升边沿 (b) 下降边沿
图3 边沿JK触?发器的逻辑?符号
4. 集成边沿J?K触发器
(1)(TTL集成?边沿JK触?发器
图4.21(a)是TTL集?成边沿JK?触发器74?LS112?引出端功能?图。
(2)(CMOS集?成边沿JK?触发器
图4 (b)是CMOS?集成边沿J?K触发器C?C4027?引出端功能?图。
(a) (b)
5.逻辑符号
Q QQ QQ Q
G G&&12
Q Q
2.特征方程
J CP K1J C1 1K
G G &&34
J CP KJ CP KJ CP K
(a) 逻辑电路(b) 曾用符号(c) 国标符号
时序逻辑电?路的分析和?设计
分析步骤:
1、 写出驱动方?程(激励)
2、 每一级的状?态转移方程?;
3、 画出状态转?移图。
4、 检查自启动?情况。
5、 写出电路功?能。
6、 画出电路
设计步骤
1、 建立原始状?态图和状态?表
2、 状态简化(个人意见,这是数字电?路设计中很?麻烦的一步?)
3、 状态分配(状态编码)
4、 选择存储器?的类型,去定存储电?路的激励输?入
5、 求输出函数?
6、 画逻辑图
7(时序逻辑电?路的特点:任一时刻输?出状态不仅?取决于当
时的输入信?号,还与电路原?来的状态有?关。因此时序电?
路中必须含?有存储器件?。
8(时序逻辑电?路的设计步?骤一般为:设计要求?原始状态转?
换图?状态化简?状态编码&触发器选择??激励表或状?态方
程?激励方程/输出方程?自启动检查??逻辑图。
(描述时序电?路逻辑功能?的方法有逻?辑方程组、状态表、 9
状态图和时?序图等。
10(时序逻辑电?路的分析步?骤一般为:逻辑图?时钟方程
异步)、激励方程、输出方程?状态方程?状态转换表?
?状态转换图?和时序图?逻辑功能。
三.设计的具体?实现
1( 系统概述
触发器:
触发器是构?成时序逻辑?电路的基本?逻辑部件。
? 它有两个稳?定的状态:0状态和1?状态;
? 在不同的输?入情况下,它可以被置?成0状态或?1状态;
? 当输入信号?消失后,所置成的状?态能够保持?不变。
所以,触发器可以?记忆1位二?值信号。根据逻辑功?能的不同,触发器可以?分为RS触?发器、D触发器、JK触发器?、T和T?触发器;按照结构形?式的不同,又可分为基?本RS触发?器、同步触发器?、主从触发器?和边沿触发?器。
同步JK触?发器
信号输出端?,Q=0、Q=1的状态称?0状态,Q=1、Q=0的状态称?1状态,信号输入端?,低电平有效?。
n将S=JQ、R=KQn代入?同步RS触?发器的特性?方程,得同步JK?触发器的特?性方程:
nnnnn,1Q,S,RQ,JQ,KQQ nn,JQ,KQ
特性表
JK=1×/状态图
×0/0×/01
×1/
CP
J波形图
K
Q
Q
在数字电路?中,凡在CP时?钟脉冲控制?下,根据输入信J、?号K情况的不?同,具有
置0、置1、保持和翻转?功能的电路?,都称为JK?触发器。
集成同步D?触发器
V4Q4D3D3Q 3Q 2Q2QV4D4Q4Q2G3Q3Q3DDD CC
16 15 14 13 12 11 10 9 16 15 14 13 12 11 10 9
CC404274LS375
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1Q1DCPPOL2D V4Q 1Q1Q 1G2Q2Q2D GND1D 1Q SS
(b) CC404的引脚图(a) 74LS375的引脚图
POL,1时,CP,1有效,锁存的内容?是CP下降?沿时刻D的?值;POL,0时,CP,
0有效,锁存的内容?是CP上升?沿时刻D的?值。
主从JK触?发器
nn 将 S,JQ R,KQ
代入主从RS?触发器的?特性方程,即可得到主?从JK触发?器的特性方?程:
nn,1QSRQ,,
nnnJQKQQ,,
nnJQKQ,,
CP下降沿到来时有效
主从JK触?发器没有约?束。
特性表
nn+1功能 J K Q Q
0 0 0 0 n,1n 保持 Q,Q
0 0 1 1
0 1 0 0 n,1 置0 Q,00 1 1 0
1 0 0 1 n,1 置1 Q,11 0 1 1
1 1 0 1 n,1n 翻转 Q,Q
1 1 1 0
时序图
逻辑符号
Q QQ Q
Q Q
CPC1 J K 1J 1K
J CP KJ CP K
曾用符号国标符号
电路特点
?主从JK触?发器采用主?从控制结构?,从根本上解?决了输入信?号直接控制?的问题,
具有 CP,1期间接收?输入信号,CP下降沿?到来时触发?翻转的特点?。
?输入信号J?、K之间没有?约束。
?存在一次变?化问题
带清零端和?预置端的主?从JK触发?器
R=0,直接置0 S=0,直接置1 DD
带清零端和?预置端的主?从JK触发?器的逻辑符?号
Q Q Q Q
Q Q
SRDS RD DDCPC1 S 1J 1K R J K
J CP K SJ CP K RDD
曾用符号国标符号
集成主从J?K触发器
VS RKK KQ1K1Q1QGND2K 2Q 2Q2JCC DD 3 2 1
16 15 14 13 12 11 10 9 14 13 12 11 10 9 8
74LS767472
1 2 3 4 5 6 7 1 2 3 4 5 6 7 8
1CP 1S 1R 1J V2CP2S 2RNC CPJJ JQ GNDDDCC DD 1 2 3
(a) 74LS76的引脚图(b) 7472的引脚图
与输入主从?JK触发器?的逻辑符号?
Q Q
1J 2K
CP&& S R
J J JCP K KKRSD 123 12 3 D
主从JK触?发器功能完?善,并且输入信J、?号K之间没有?约束。但主从JK?触发器还存?在着一次变?化问题,即主从JK?触发器中的?主触发器,在CP,1期间其状?态能且只能?变化一次,这种变化可?以是J、K变化引起?,也可以是干?扰脉冲引起?,因此其抗干?扰能力尚需?进一步提高?。
边沿JK触?发器
Q Q
nnD,J,Q,KQ
&&nn ,(J,Q),KQ
nn,(J,Q)(K,Q)&&
nn ,JQ,KQ,JK1nn,JQ,KQ
&&1
,1nQ,D&&nnJ ,JQ,KQ?1
?11D&KCP
CP下降沿?时刻有效
边沿JK触?发器的逻辑?符号
Q QQ Q
Q Q CP J K C1 1J 1K
J CP K J CP K
国标符号曾用符号
边沿JK触?发器的特点?
?边沿触发,无一次变化?问题。
?功能齐全,使用方便灵?活。
?抗干扰能力?极强,工作速度很?高。
集成边沿J?K触发器
2Q2Q2CP2R2K 2J2SV1R2R2CP2K2J2S 2QVDD D DCC D D D
16 15 14 13 12 11 10 9 16 15 14 13 12 11 10 9
CC402774LS112
1 2 3 4 5 6 7 8 1 2 3 4 5 6 7 8
1Q1Q1CP1R1K1J1S V1CP1K1J1S1Q1Q2Q GND D DSS D
(b) CC4027的引脚图(a) 74LS112的引脚图
?74LS1?12为CP?下降沿触发?。
?CC402?7为CP上?升沿触发,且其异步输?入端RDSD和为高电??平有效。
触发器是数?字电路的极?其重要的基?本单元。触发器有两?个稳定状态?,在外界信号?作用下,可以从一个?稳态转变为?另一个稳态?;无外界信号?作用时状态?保持不变。因此,触发器可以?作为二进制?存储单元使?用。
触发器的逻?辑功能可以?用真值表、卡诺图、特性方程、状态图和波?形图等5种?方式来描述?。触发器的特?性方程是表?示其逻辑功?能的重要逻?辑函数,在分析和设?计时序电路?时常用来作?为判断电路?状态转换的?依据。
各种不同逻?辑功能的触?发器的特性?方程为:
n+1nRS触发器?:Q=S+RQ,其约束条件?为:RS,0
n+1nnJK触发器?: Q=JQ+KQ
n+1D触发器: Q=D
n+1nnT触发器: Q=TQ+TQ
n+1nT,触发器: Q=Q
可以用不同?的电路结构?形式来实现?;反过来,同 同一种功能?的触发器,
一种电路?结构形式,可以构成具?有不同功能?的各种类型?触发器。
时序电路的?特点:
逻辑电路分?为两类:一类是组合?逻辑电路,另一类是时?序逻辑电路?。在组合逻辑?电路中,任一时刻的?输出仅与该?时刻输入变?量的取值有?关,而与输入变?量的历史情?况无关;在时序逻辑?电路中,任一时刻的?输出不仅与?该时刻输入?变量的取值?有关,而且与电路?的原状态,即与过去的?输入情况有?关。
与组合逻辑?电路相比,时序逻辑电?路有两个特?点:第一,时序逻辑电?路包含组合?逻辑电路和?存储电路两?部分,存储电路具?有记忆功能?,通常由触发?器组成;第二,存储电路的?状态反馈到?组合逻辑电?路的输入端?,与外部输入?信号共同决?定组合逻辑?电路的输出?。组合逻辑电?路的输出除?包含外部输?出外,还包含连接?到存储电路?的内部输出?,它将控制存?储电路状态?的转移。
时序电路的?分类
&&Z
QQQ0121J1J1J
C1C1C1 1K1K1K
FFFFFFCP012
同步二进制?加法计数器?
&Z
QQ01 Q1J1J1J2CPC1C1C1
1K1K1K
FFFFFF012
异步二进制?加法计数器?
时序电路按?输出信号的?特点又可以?分为米里(Mealy?)型和摩尔(Moore?)型时序电路?两种。Mealy?型时序电路?的输出函数?为 Z= F(X,Q),即某时刻的?输出决定于?该时刻的外?部输入X和?内部状态Q?,如图6-4所示的M?ealy型?串行加法器?电路。在该电路中、bi?,为串行a?数i
据输入,si为串行?数据输出,=sa+b+c,或s= a+b+Q。Moore?型时序电路?的输出函数?为 Z iiii-1iii
= F(Q),如图6-5所示的M?oore型?串行加法器?电路。在该电路中?串行数据输=Q。?Mealy出s?i1型串行加法?器电路和M?oore型?串行加法器?电路具有相?同的逻辑功?能,但Moor?e型串行加?法器电路的?输出比Me?aly型串?行加法器的?输出迟一个?节拍。
Mealy?型串行加法?器电路
ai?SibiC i,1CCCIOi
FF Q1D
C1
CP
(S)aii?bi SCiiCi,1CCIO
FFFF01
QQ011D1D
C1C1
CP
Moore?型串行加法?器电路
时序电路的?功能描述:
1. 逻辑方程式? Z,F(X,Q)
Y,G(X,Q) n,1Q,H(Y,Q)
2. 状态转移表?
状态转移表?也称状态迁?移表或状态?表,是用列表的?方式来描述?时序逻辑电?路输
n+1和外部输?出Z、次态Q入X、现态Q之间?的逻辑关系?。
Mealy?型时序电路?状态表
Moore?型时序电路?状态表
Moore? 型电路简化?状态表
3.状态图
001/100/000/100000101001111/001/111/0 00/001/00001100/0X/ZX10
10/1 11/0011011111010110010/1QQX11/010
101/1 QQ/Z11/110/010111000/101/1QQQ21010/110/1
0
(a)(b)(c)
4.时序图
即为时序电?路的工作波?形图,它以波形的?形式描述时?序电路内部?状态Q、外部输出Z?随输
入信号?X变化的规?律, 其具体画法?将在下面讨?论 。 以上几种同?步时序逻辑?电路功能
描?述的方法,各有特点,但实质相同?,且可以相互?转换,它们都是同?步时序逻辑?电路分
析和?设计的主要?工具。
同步时序逻?辑电路的一?般分析方法?
? 根据逻辑图?求出时序电?路的输出方?程和各触发?器的激励方?程。
? 根据已求出?的激励方程?和所用触发?器的特征方?程, 获得时序电?路的状态方?程。
? 根据时序电?路的状态方?程和输出方?程, 建立状态转?移表, 进而画出状?态图和波形?图。
? 分析电路的?逻辑功能。
2( 电路分析与?设计(小三号宋体?)
有效状态有?4个,故需两个触?发器。设两触发器?输出Q1Q? , 则根据课本0?323页图?题6.3.3可得状态?表如图6-1(a)
0 1
A
n n QQ 0 1
n,1n,1 Q Q /z 1 0根
据状
00 00/0 01/0 态表?
和JK
触发?01 11/0 01/0
器的
激励10 00/0 10/1
表?如
表
11 11/1 10/1 6-1
(b)
nn+1 QQ J K
0 0 0 X
0 1 1 X
1 0 X 1
1 1 X 0
可得两触发?器的激励函?数和输出函?数真值表如?表6-1(c)。
n,1n,1n n A QQ Z JK JK Q Q 1 10 00 1 0 1
0 0 0 0 0 0 0 X 0 X
0 0 1 1 1 0 1 X X 0
0 1 0 0 0 0 X 1 0 X
0 1 1 1 1 1 X 0 X 0
1 0 0 0 1 0 0 X 1 X
1 0 1 0 1 0 0 X X 0
1 1 0 1 0 1 X 0 0 X
1 1 1 1 0 1 X 0 X 1
由此真值表?可画出下列?卡诺图如图?6-2(由此真值表a)。?可画出下列?卡诺图如图?6-2( a)。
n n J1?QQ 0 100 01 11 10
1 X X 0
X X 1
化简得:
J= , K= ; J = A , K = A , AQ0Q1AQQ11 1 0 00Z=A+ Q1Q1Q0
根据上述驱?动方程可画?出逻辑电路?如图6-2(b)。
四(心得体会及?建议
数电课程设?计是培养学?生综合运用?所学知识,发现,提出,分析和解决?实际问题,锻炼实践能?力的重要环?节,是对学生实?际工作能力?的具体训练?和考察过程?.回顾起此次?课程设计,至今我仍感?慨颇多,的确,从选题到定?稿,从理论到实?践,在短短的两?个星期的日?子里,可以说得是?苦多于甜,但是可以学?到很多很多?的的东西,同时不仅可?以巩固了以?前所学过的?知识,而且学到了?很多在书本?上所没有学?到过的知识?。通过这次数?电课程设计?使我懂得了?理论与实际?相结合
只有理论知?识是远远不?够的,只有把所学?的理论知识?与实践相结?是很?重要的,
合起来,从理论中得?出结论,从而提高自?己的实际动?手能力和独?立思考的能?力。在设计的过?程中遇到问?题,可以说得是?困难重重,这毕竟第一?次做数电课?程设计,难免会遇到?过各种各样?的问题,同时在设计?的过程中发?现了自己的?不足之处,对以前所学?过的知识理?解得不够深?刻,掌握得不够?牢固。
通过本次课?程设计,我明白了一?个道理:无论做什么?事情,都必需养成?严谨,
认真,善思的工作?作风.
时间很紧,这一周又在?忙碌中过去?了,经过一周的?数电课程设?计,我从原先看?见状态图就?一头雾水到?现在能够设?计复杂的同?步时序电路?,并且能够实?现电路的仿?真与实物板?的制作与调?试,之间的巨大?变化着实令?人吃惊。但是这种进?步来之不易?,因为这期间?我遇到了很?多的困难,发现了很多?的问题,正是在解决?问题的期间?我才慢慢地?熟悉了数字?电子技术基?础的基础知?识,才慢慢学会?了如何去按?照给定的要?求设计出合?适的电路,作出电路的?实物并对电?路进行调试?。
本次课程设?计主要是运?用本学期所?学到的数字?电子技术基?础知识来设?计一个符合?要求的数字?钟,本次设计不?仅要求我们?要掌握数字?电子技术基?础课程的基?础知识,还要求我们?对数字钟的?各个组成部?分的原理都?有深刻的理?解和掌握,本次课程设?计最重要的?是要求我们?能够运用所?学的知识将?几种单元电?路组合起来?,并且能够根?据给定性能?指标求解电?路中的参数?,最后在实践?方面还要求?我们要有一?定的动手能?力.
课设的这段?日子真的是?给我留下了?很深的印象?。我总结出,在每次课设?中,遇到问题最?好的办法就?是请教别人?,因为每个人?掌握的情况?都不一样,一个人不可?能做到处处?都懂,必须发挥群?众的力量,复杂的事情?才能够简单?化。这一点我深?有体会,在很多时候?,我遇到的困?难或许别人?之前就遇到?过,向他们请教?远比自己在?那边摸索来?得简单,来得快。
在这次课程?设计过程中?,我也遇到了?很多问题。比如在真值?表、波形图成正?时,我就弄了很?长时间,先是远离不?清晰,这直接导致?了我无法很?顺利地连接?电路,然后翻阅了?大量书籍,查资料,终于在书中?查到了有关?章节,并参考,编辑推荐:并设计出了?真值表、波形图。但在设计数?字频率计时?就不是那么?一帆风顺了?。我同样是查?阅资料,虽找到了原?理框图,但电路图却?始终设计不?出来,最后实在没?办法,只能用数字?是中来代替?。在此,我深表遗憾?!
这次课程设?计让我学到?了很多,不仅是巩固?了先前学的?模电、数电的理论?知识,而且也培养?了我的动手?能力,更令我的创?造性思维得?到拓展。希望今后类?似这样课程?设计、类似这样的?锻炼机会能?更多些!
五(附录
与运算 上升沿触发?的JK触发?器
或运算 非运算
六(参考文献(三号宋体)
参考文献的?格式如下:
[1] 伍时和主编?.数字电子技?术基础。清华大学出?版社,2009.4 [2] 高建新等主?编.电子技术实?验与实训。机械工业出?版社,2006.8
[3] 高吉祥主编?.电子技术基?础实验与课?程设计.电子工业出?版社,2002
[4] 孙淑艳主编?.电子技术实?践教学指导?书.中国电力出?版社,2005.10
[5] 吴老师.贵州大学数?字电子基础?指导老师课?件,2010. ([M]表示杂志刊?物,[J]表示学术论?文,[N]为报纸文章?,如果参考文?献来自网络?,必须附上网?址及访问时?间。)